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DDR=Double Data Rate双倍速率同步动态随机存储器。严格的说DDR应该叫DDR SDRAM，人们习惯称为DDR，其中，SDRAM 是Synchronous Dynamic Random Access Memory的缩写，即同步动态随机存取存储器。

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Xilinx DDR控制器MIG IP核的例化及仿真

DDR对于做项目来说，是必不可少的。一般用于数据缓存和平滑带宽。今天介绍下Xilinx DDR控制器MIG IP核的例化及仿真。 FPGA芯片：XC7K...

2020-11-26 标签：fpga DDR Xilinx 8810 0

电路板上的线路不能直接设计成直线吗？

要是我们将电路板中的线路设计成直线，那么这个转弯的角度就达到了九十度。因为线路在九十度转弯时很容易就产生反射，这样的电路板在生产的过程中很容易就会被折断。

2020-11-25 标签：pcb 电路板 DDR 2529 0

FPGA案例解析：针对源同步的时序约束

约束流程说到FPGA时序约束的流程，不同的公司可能有些不一样。反正条条大路通罗马，找到一种适合自己的就行了。从系统上来看，同步时序约束可以分为系统同步...

2020-11-20 标签：fpga pcb DDR 8044 0

Zynq-7000的256KB OCM应用程序运行

某些应用程序小，可以全部放在Zynq-7000的256KB OCM上运行。这时，修改FSBL，可以把APP和FSBL编译成一个可执行文件，FSBL初始化...

2020-11-02 标签：fpga FlaSh DDR 3015 0

基于Vivado/SDK 2018.3的XIP参考设计

有些应用中，单板没有DDR，OCM又不够存储所有数据和指令。这种情况下，Xilinx提供了参考设计Zynq-7000 AP SoC Boot - Boo...

2020-10-09 标签：FlaSh DDR Xilinx 3525 0

ZCU10中MPSoC对DDR复位信号设计

Xilinx的开发板ZCU102支持休眠到内存（suspend-to-ram）。休眠到内存时，DDR进入自刷新，MPSoC被关电，完全不耗电。唤醒时，M...

2020-11-04 标签：单片机 DDR Xilinx 2920 0

JEDEC定义了应用广泛的三类DRAM标准

标准 DDR 面向服务器、云计算、网络、笔记本电脑、台式机和消费类应用，支持更宽的通道宽度、更高的密度和不同的形状尺寸。DDR4 是这一类别目前最常用的...

2020-06-08 标签：DDR soc LPDDR5 6729 0

被吹捧的LPDDR5到底是个啥?DDR5 的主要功能介绍

选择合适的存储器解决方案是满足目标系统对各种应用（从云计算和人工智能（AI），再到汽车和移动应用）的功能和性能要求的关键。

2020-04-27 标签：三星电子存储器 DDR 4.3万 0

什么是DDR5 浅谈SDRAM 技术发展历程

DDR5 是第五代 DDR SDRAM 的简称，DDR SDRAM 是英文 Double Data Rate SDRAM 的缩写，中文译为双倍速率 SD...

2020-02-03 标签：SDRAM DDR DDR5 6366 0

PCB布线设计时如何通过线长匹配来保证系统的时序

数据信号与DQS做等长。为啥要做等长？大家会说是要让同组信号同时到达接收端，好让接收芯片能够同时处理这些信号。

2020-01-06 标签：DDR PCB布线线长匹配 1698 0

广州俱进科技：PCB存储模块设计小总结

PCB布局:内存中的数据是用来被控制器(CPU,如DSP 、MCU 、ARM 、FPGA 等)读写的,因此需要结合PCB 单板尺寸、器件密度、走线密度情...

2020-01-03 标签：SDRAM FlaSh DDR 8940 0

DDR存储器的信号完整性讨论

当今电子产品一个很重要的区分元素是其所用的存储器。服务器、计算机、智能手机、游戏机、GPS 以及几乎所有类似产品使用的都是现代处理器和 FPGA。这些设...

2019-12-11 标签：存储器接口 ddr 4740 0

DDR3 SDRAM的IP核调取流程

学完SDRAM控制器后，可以感受到SDRAM的控制器的书写是十分麻烦的，因此在xilinx一些FPGA芯片内已经集成了相应的IP核来控制这些SDRAM，...

2019-11-10 标签：控制器 ddr ip核 5281 0

S参数的损耗曲线到底怎么来的？

判断好坏的标准都是时域的电平标准，没涉及到频域，另外是像这种一拖多的拓扑，S参数的确看得会很乱而且意义不明确，另外也有人会觉得像并行信号1-2GHz看S...

2019-10-02 标签：DDR S参数 7185 0

DDR信号仿真的信号质量与时序分析

该波形电压虽然都通过了门限电平，但是裕量很小，波形也是参差不齐，显然不够理想。我们这里仅仅仿真了单根信号的质量，如果把串扰也考虑进来，波形就很难保证不出...

2019-10-04 标签：DDR PCB设计 ddr布线 2456 0

DDR仿真处理多级IO的惯性延迟问题

DDR验证是任何SoC中最关键和最复杂的任务之一，因为它涉及位于DUT内部的控制器和位于DUT外部的外部DDR存储器。 DDR系统由控制器，I/O，封装...

2019-08-12 标签：DDR PCB打样华强PCB 4645 0

运行DDR的门级仿真可以找到的各种类型的问题

无论高级静态时序分析（STA）工具如何成型，运行GLS仍然有很多优势，因为它能够发现很多隐藏的设计问题，这些问题在RTL中很难找到模拟。它清晰地展示了设...

2019-08-12 标签：DDR 仿真 PCB打样 2834 0

Spartan-3的FPGA与DDR2 SDRAM的接口实现

DDR2 设备概述：DDR2 SDRAM接口是源同步、支持双速率传输。比如DDR SDRAM ,使用SSTL 1.8V/IO电气标准，该电气标准具有较低...

2019-06-22 标签：fpga 接口 ddr 2174 0

DDR的布线问题讨论

在现代高速数字电路的设计过程中，工程师总是不可避免的会与DDR或者DDR2，SDRAM打交道。DDR的工作频率很高，因此，DDR的布线（或者Layout...

2019-06-08 标签：ddr layout 布线 4833 0

DDR高速信号线的布线原则和技巧

在普通印制电路板的布线中由于信号是低速信号，所以在3W原则的基本布线规则下按照信号的流向将其连接起来，一般都不会出现问题。但是如果信号是100M以上的速...

2019-03-24 标签：ddr 布线 7946 1

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