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　design，中文是设计之意，即“设想和计划，设想是目的，计划是过程安排”，通常指有目标和计划的创作行为、活动。在这个竞争激烈的数字化信息时代，企业建立自己的网站已经刻不容缓。

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Vivado 2024.1版本的新特性(2)

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2024-09-18 标签：代码 design Vivado 638 0

Vivado 2024.1版本的新特性(1)

Vivado 2024.1已正式发布，今天我们就来看看新版本带来了哪些新特性。

2024-09-18 标签：design 编译 Vivado 927 0

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2023-07-24 标签：寄存器电路设计 design 492 0

简述Vivado中的Elaborate的作用

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2023-05-05 标签：RTL design Vivado 1223 0

Congestion修复实例及脚本分享-加Blockage array/keepout margin

　　分享一个Congestion的示例与解决这个Congestion用的2种方法以及对应的效果。

2023-01-31 标签：Cell design 脚本 1378 0

反相器的verilog设计和仿真

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StarRC教程-如何基于Dummy/Metal Fill GDS抽取寄生RC文件

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2022-12-08 标签：design GDS StarRC 6461 0

Vivado中的Elaborate是做什么的？

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2022-10-24 标签：design Synthesis Vivado 1429 0

如何在Qt Design Studio中创建连接和状态

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2022-09-16 标签：Studio design Qt 2291 0

XDMA/PCIE IP的定制和Block Design的搭建

上一篇内容我们已经对PCIE协议进行了粗略的讲解。那么不明白具体的PCIE协议，我们就不能在FPGA中使用PCIE来进行高速数据传输了吗？答案是否定的。...

2022-06-01 标签：fpga Xilinx PCIe 1.1万 0

123D Design修改Axidraw X轴STL文件的方法

这是Axidraw制作过程中的一个小小的改动，增加了Eitbitboard主板和Arduinouno主板的安装位置。

2022-04-14 标签：主板 design 4526 0

用Elaborated Design优化RTL的代码

在Vivado FlowNavigator中有一个Elaborated Design，如下图所示，属于RTL Analysis这一步对应的设计。可能很多...

2020-10-21 标签：RTL design 5283 0

新Vivado报告命令的了解

了解report_design_analysis，这是一个新的Vivado报告命令，可以独特地了解时序和复杂性特征，这些特性对于分析时序收敛问题很有价值。

2018-11-26 标签：赛灵思时序 design 3605 0

如何使用Vivado Design Suite IP Integrator的调试AXI接口

了解如何使用Vivado Design Suite IP Integrator有效地调试AXI接口。本视频介绍了如何使用该工具的好处，所需的调试步骤和演示。

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如何在Vivado Design Suite 中进行IP加密

此视频概述了Vivado Design Suite中的IP加密。它涵盖了IP加密工具流程，如何准备加密IP以及如何在Vivado中运行加密工具。

2018-11-20 标签：赛灵思 ip design 6453 0

Vivado Design Suite设计套件的UltraFast设计方法的介绍

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Vivado Design Suite 2016中的新功能介绍

新的器件支持包括：Kintex®UltraScale+™，Zynq®UltraScale+ MPSoC和所有Vivado HLx版本的单核Zynq-70...

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Vivado Design Suite 2015.3新增量编译功能介绍

了解Vivado实现中2015.3中的新增量编译功能，包括更好地处理物理优化和自动增量编译流程。

2018-11-20 标签：赛灵思 design 编译 2819 0

Vivado Design Suite 2015.3的新功能介绍

了解Vivado实现中2015.3中的新增量编译功能，包括更好地处理物理优化和自动增量编译流程。

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