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fifo

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First Input First Output的缩写，先入先出队列，这是一种传统的按序执行方法，先进入的指令先完成并引退，跟着才执行第二条指令。

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fifo技术

FIFO的一些基础知识

FPGA厂商提供了丰富的IP核，基础性IP核都是可以直接免费调用的，比如FIFO、RAM等等。

2023-08-07 标签：fpga fifo IP核 2302 0

FPGA FIFO深度计算的基本步骤和示例

FIFO(First In First Out)是一种先进先出的存储结构，经常被用来在FPGA设计中进行数据缓存或者匹配传输速率。

2023-08-07 标签：fpga fifo 存储结构 1085 0

如何在Vivado中配置FIFO IP核

Vivado IP核提供了强大的FIFO生成器，可以通过图形化配置快速生成FIFO IP核。

2023-08-07 标签：接口 fifo IP核 4270 0

异步FIFO原理及使用

由Binary Pointer生成Gary Pointer，其实这里根据经典AFIFO论文[1]里应该是用新的wptr_bin_next生成wptr_g...

2023-08-05 标签：二进制 fifo Pointer 487 0

RA6T2的16位模数转换器操作 [7] 配置RA6T2 ADC模块 (4)

2 配置RA6T2 ADC模块 2.1 ADC规范 2.1.8 中断源 A/D转换器外设可以创建多种中断源和ELC事件请求。本节将列出提供的中断源，并详...

2023-07-31 标签：mcu adc 瑞萨 1028 0

跨时钟设计：异步FIFO设计

在ASIC设计或者FPGA设计中，我们常常使用异步fifo（first in first out）（下文简称为afifo）进行数据流的跨时钟，可以说没使...

2023-07-31 标签：fpga asic 接口 2239 0

常见的流控机制之fifo与带外流控

FIFO（first in first out）是一种用寄存器reg或者RAM实现的存储结构，常用于存储数据通道中的数据流，采用先入先出的数据，当下游模...

2023-07-26 标签：寄存器 RAM fifo 1447 0

使用IP核创建单时钟FIFO

FIFO，先进先出。在FPGA中使用的FIFO一般是指对数据的存储具有先进先出的缓冲器，FIFO与普通的存储器的不同在于它没有读写地址线。举个例子，当F...

2023-07-23 标签：传感器 fifo 时钟 741 0

ESP32学习笔记：串口

ESP32 芯片有3 个UART 接口，UART0，UART1，UART2，支持异步通信和 IrDA，通信速度最高可达 5Mbps，3 个接口可以被 D...

2023-07-13 标签：fifo 串口 uart 6998 0

10个MCU常用的基础知识，收藏了！

从外观上看，如将两种蜂鸣器的引脚都朝上放置时，可以看出绿色电路板的一种是源蜂鸣器，没有电路板而用黑胶密封的一种是有源蜂鸣器。

2023-07-23 标签：mcu 电路板 fifo 817 0

时序约束出现时序违例(Slack为负数)，如何处理？

2023-07-10 标签：fifo 加法器时序约束 5241 0

FIFO和RAM，到底用哪个？

在FPGA的设计中的，内部的FIFO和RAM是两种非常常见的存储单元

2023-07-11 标签：存储单元 RAM fifo 1433 0

浅谈FPGA芯片架构

FPGA 芯片架构是非常重要的，如果你不了解 FPGA 芯片内部的详细架构。

2023-07-04 标签：fpga fifo 时钟 1242 0

MSPM0L1306开发板教程之I2C

MSPM0L系列的I2C支持主从模式，有7位地址位可以设置，速率最大1Mbps，无论是主机或者从机，发送和接收都有独立的8个字节FIFO。

2023-06-30 标签：fifo 时钟 EEPROM 4061 0

跨时钟域处理方式

类似于电源域（电源规划与时钟规划亦是对应的），假如设计中所有的 D 触发器都使用一个全局网络 GCLK ，比如 FPGA 的主时钟输入，那么我们说这...

2023-06-21 标签：fpga fifo 时钟 3447 0

以太网时钟的PPM频率偏差的解决方案(下)

图<6>是深度(depth)为8的异步FIFO的示意图。其中，0～7代表8个寄存器，他们组成了一个环。

2023-06-23 标签：以太网寄存器 fifo 3170 0

基于寄存器的同步FIFO

FIFO 是FPGA设计中最有用的模块之一。FIFO 在模块之间提供简单的握手和同步机制，是设计人员将数据从一个模块传输到另一个模块的常用选择。在...

2023-06-14 标签：寄存器数据 fifo 756 0

DS3112发送时钟的时钟速率和频率容差

DS3112具有六种不同的发送时钟和六种不同的接收时钟类型：发送DS3、DS2、DS1、E3、E2和E1时钟，以及接收DS3、DS2、DS1、E3、E2...

2023-06-13 标签：芯片 fifo 端口 596 0

适用于低功耗信号链应用的功率优化技术

本文介绍用于在低功耗信号链应用中实现优化能效比的精密低功耗信号链解决方案和技术。本文将介绍功耗调节、功率循环和占空比等用于进一步降低系统功耗的技术（不仅...

2023-06-13 标签：放大器 adc FIFO 717 0

FPGA算法技术交流问答集锦

有用过xilinx FIFO的first word fall through模式，然后write data count会少2个计数的吗？

2023-06-12 标签：fpga Xilinx fifo 651 0

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