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fifo

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First Input First Output的缩写，先入先出队列，这是一种传统的按序执行方法，先进入的指令先完成并引退，跟着才执行第二条指令。

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fifo技术

在icestick板子上实现从FPGA到USB Host的数据传输

icestick 板载 USB 接口芯片 FT2232H 的端口 A 和端口 B 均与 FPGA ice40hx1k 相连。

2023-03-09 标签：fpga usb fifo 1526 0

陀螺仪LSM6DSV16X与AI集成(7)----FIFO数据读取与配置

LSM6DSV16X是一款高性能、低功耗的6轴IMU传感器，集成了3轴加速度计和3轴陀螺仪。本文将详细介绍如何配置和读取LSM6DSV16X传感器的FI...

2024-07-18 标签：陀螺仪 fifo AI 1474 0

Synwit SWM系列单片机的UART FIFO详解

如何配合接收门限中断、接收超时中断完成UART数据接收。

2023-03-03 标签：芯片单片机 fifo 1474 0

FPGA学习-总结fifo设计中深度H的计算

对于fifo来说，H的设置至关重要。既要保证功能性，不溢出丢数，也要保证性能流水。深度设置过小会影响功能，过大又浪费资源。因此，总结下fifo设计中深度...

2022-08-29 标签：fpga fifo 1470 0

LogiCORE IP AXI4-Stream FIFO内核解决方案

LogiCORE IP AXI4-Stream FIFO内核允许以内存映射方式访问一个AXI4-Stream接口。该内核可用于与AXI4-Stream ...

2023-09-25 标签：内核 fifo dma 1465 0

常见的流控机制之fifo与带外流控

FIFO（first in first out）是一种用寄存器reg或者RAM实现的存储结构，常用于存储数据通道中的数据流，采用先入先出的数据，当下游模...

2023-07-26 标签：寄存器 RAM fifo 1447 0

驱动LSM6DS3TR-C实现高效运动检测与数据采集(6)----FIFO数据读取与配置

LSM6DS3TR-C是STMicroelectronics公司推出的iNEMO惯性模块，集成了三轴加速度计和三轴陀螺仪，具备低功耗、强大的运动检测功能...

2024-07-18 标签：陀螺仪数据采集 fifo 1445 0

FIFO和RAM，到底用哪个？

在FPGA的设计中的，内部的FIFO和RAM是两种非常常见的存储单元

2023-07-11 标签：存储单元 RAM fifo 1433 0

单片机串口发送数据很慢？这种方法帮助你提高！

2023-11-02 标签：单片机 fifo 串口 1432 0

利用光纤通道协议和异步FIFO实现FC-AL通信弹性缓存的设计

一个简化的异步数据通信系统如图1所示。接收机端从接收到的来自串行链路的比特流中提取时钟信号Clk1，作为其工作时钟源；而发送机端采用本地晶振和锁相环产生...

2020-05-13 标签：光纤通信 fifo 1407 0

异步FIFO设计之格雷码

相邻的格雷码只有1bit的差异，因此格雷码常常用于异步fifo设计中，保证afifo的读地址（或写地址）被写时钟（或读时钟）采样时最多只有1bit发生跳变。

2023-11-01 标签：fifo 格雷码异步FIFO 1399 0

FPGA集成数据缓冲器与分离FIFO

许多年轻的工程师在工作中考虑潜在设计选项时首先想到可编程逻辑。然而，随着对可编程逻辑的日益依赖也给教授电路设计带来了经常被忽略的一些问题，这使许多年轻的...

2017-11-24 标签：存储器 fifo 1358 0

为什么格雷码可以辅助解决多bit跨时钟域的问题？求解

单bit通过两级同步打拍可以有效的解决亚稳态问题。

2024-03-08 标签：二进制 fifo RTL 1324 0

FIFO为什么不能正常工作？

FIFO为什么不能正常工作？复位信号有效长度不够，接口时序不匹配，可看下面这篇文章。本文将介绍：非DFX工程如何确保异步FIFO自带的set_max...

2023-11-02 标签：fpga FPGA设计 fifo 1310 0

DS3112 DS3/E3多路复用成帧器如何恢复低速时钟信号

第一级，即M23级，将DS3信号解复用为7个独立的DS2信号。不是恢复单个DS2时钟，而是创建DS2使能。七个DS2使能中的每一个都处于活动状态，每个D...

2023-01-13 标签：fifo 时钟 1305 0

Verilog电路设计之单bit跨时钟域同步和异步FIFO

FIFO用于为匹配读写速度而设置的数据缓冲buffer，当读写时钟异步时，就是异步FIFO。多bit的数据信号，并不是直接从写时钟域同步到读时钟域的。

2023-01-01 标签：fifo Verilog 1281 0

功能覆盖率应该包含哪些内容？

如果某个场景已经使用了covergroup覆盖，就不需要使用SVA cover重复覆盖

2022-11-22 标签：fifo SVA 1274 0

基于FPGA器件实现复用器输入部分的设计方案

整个传送流的复用器分为复用预处理、输入和复用3部分。预处理部分是对多路传送流的PSI（节目特殊信息）提取并修改，重新生成新的PSI表的过程；输入部分是给...

2020-08-25 标签：fpga fifo 复用器 1273 0

谈一谈FIFO的深度

最近加的群里面有些萌新在进行讨论**FIFO的深度**的时候，觉得 **FIFO的深度计算比较难以理解** 。所

2023-11-28 标签：IC设计 fifo 时钟源 1273 0

采用格雷码异步FIFO跟标准FIFO有什么区别

异步FIFO包含"读"和"写“两个部分，写操作和读操作在不同的时钟域中执行，这意味着Write_Clk和Read_Clk的...

2023-09-14 标签：fifo 信号时钟域 1258 0

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