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fpga设计

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FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。

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fpga设计技术

EDA工具如何为FPGA设计提供便捷高效的设计环境

如今FPGA已进入硅片融合时代，集成了DSP、ARM等，这种混合系统架构需要更好的开发环境，如嵌入式软件工具OS支持、DSP编程、基于C语言的编程工具、...

2019-01-25 标签：fpga设计 eda工具 1065 0

如何优化FPGA HLS设计呢？

用工具用 C 生成 RTL 的代码基本不可读。以下是如何在不更改任何 RTL 的情况下提高设计性能。

2023-10-30 标签：arm 滤波器 FPGA设计 1064 0

ASIC的clock gating在FPGA里面实现是什么结果呢？

首先，ASIC芯片的clock gating绝对不能采用下面结构，原因是会产生时钟毛刺

2023-08-25 标签：转换器 FPGA设计寄存器 1051 0

AMBA4—无聊的Narrow transfers介绍

AMBA总线无论FPGA还是ASIC，应该都是比较常用的一组总线协议。

2023-06-11 标签：FPGA设计 AMBA总线 ASIC芯片 1046 0

异步电路的跨时钟域处理

异步电路不能根据时钟是否同源来界定，时钟之间没有确定的相位关系是唯一准则。

2023-06-27 标签：FPGA设计芯片设计异步电路 1046 0

赛灵思FPGA设计技巧与应用创新

上一次我们提到可以利用本地存储的训练序列与接收到的序列进行匹配滤波（相关）的方法来搜寻精确的OFDM符号起始位置。

2017-02-11 标签：FPGA FPGA设计赛灵思 1037 0

FPGA设计的五个主要任务

FPGA设计的五个主要任务：逻辑综合、门级映射、整体功能逻辑布局、逻辑资源互连布线，最后生成FPGA的bit流

2023-04-06 标签：FPGA设计 EDA工具 SoC芯片 1035 0

如何又快又好的梳理和利用验证feature文档

我们不再继续细化赘述，相信大家从举例中已经有点感觉了，什么叫“粗”，什么叫“细”，这里说到的粗细，其实就是指的是验证feature的颗粒度。

2022-10-09 标签：FPGA设计 EDA工具中断 1031 0

FPGA设计存在的4类时序路径

命令set_multicycle_path常用来约束放松路径的约束。通常情况下，这种路径具有一个典型的特征：数据多个周期翻转一次，如下图所示。因此，我们...

2023-09-14 标签：fpga FPGA设计命令 1031 0

FPGAer浅入浅出DDR

对于DDR的理解，最初简单的以为无非一个大的数组，我会接口使用就OK了。

2023-06-28 标签：FPGA设计 DDR DRAM芯片 1014 0

FPGA Vivado-TLC549驱动设计介绍

在生活中，数模转换的例子到处可见。但是在我们做FPGA设计时，需要对数字信号进行处理，但是，不是所有的信号都是以数字信号的形式体现的，比如光信号、声信号...

2023-07-27 标签：fpga FPGA设计寄存器 1011 1

inout连接不上如何解决呢

在SpinalHDL 1.7.0版本里，在仿真方面开始支持了VCS，这解决了在FPGA设计里采用Verilator时无法仿真厂商IP的问题。

2022-10-18 标签：FPGA设计 DDR VCS 1001 0

FPGA设计的经验技巧

当然，任何编程语言的学习都不是一朝一夕的事，经验技巧的积累都是在点滴中完成，FPGA设计也无例外。下面就以我的切身体会，谈谈FPGA设计的经验技巧。

2022-10-25 标签：FPGA设计 HDL 编程语言 985 0

总结一下在时序分析中的基本概念及基本术语

下图是一个经典时序分析模型，无论寄存器A与寄存器B是否在同一个芯片中，下列概念均适用。

2023-07-03 标签：FPGA设计寄存器时序分析 976 0

FPGA零基础学习之TLC5620驱动教程

在FPGA处理完数字信号之后，我们有些情况下是需要将数字信号转变为模拟信号再输出的。比如音频信号在滤波后，需要转换为声音信号进行输出。

2023-08-04 标签：示波器 FPGA设计锁存器 974 0

FPGA零基础之Vivado-超声波驱动设计

声音是我们日常生活中不可缺少的一种信号，在传递信息的同时，也在生活中的各个领域有较多的应用。

2023-10-18 标签：驱动器 FPGA设计接收器 970 0

FPGA状态机设计思想

硬件电路设计通常以并行方式实现，但是在实际工程中经常会存在系统按照顺序逻辑执行的需求。

2023-07-17 标签：FPGA设计 RTL 状态机 959 0

为保证数字电路时序裕量所做的努力

由于以太网测试使用的开发板是淘宝购买的某款开发板，开发人员在电路设计时没有考虑到将以太网芯片的接收时钟、发送时钟通过FPGA的专用时钟管脚接入到到全局时钟网络

2023-06-19 标签：FPGA设计以太网寄存器 957 0

Mojo v3 FPGA板与16x2 LCD模块是如何进行连接的呢？

在本教程中，我们将使用Verilog HDL设计一个数字电路，该电路与基于HD44780 LCD控制器/驱动芯片的通用LCD模块连接。Mojo V3 F...

2023-09-20 标签：FPGA设计 LCD控制器多路复用器 954 0

IP库新增10多个功能IP简介

一直想做一个可以供大家学习、使用的开源IP库，类似OpenCores，OC上IP在领域内的IP很少，通用性强一点，所以作为OC的“补充”，所以做了一个开...

2023-05-06 标签：FPGA设计接收器 FIR 939 0

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为防止静电积累所引起的人身电击、火灾和爆炸、电子器件失效和损坏，以及对生产的不良影响而采取的防范措施。其防范原则主要是抑制静电的产生，加速静电泄漏，进行静电中和等。
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ArduBlock软件是Arduino官方编程环境的第三方软件，目前必须依附于Arduino软件下运行，区别于Arduino文本式编程环境，ArduBlock是以图形化积木搭建的方式编程的，这样的方式会使编程的可视化和交互性加强，编程门槛降低，即使没有编程经验的人也可以尝试给Arduino控制器编写程序。
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特性阻抗又称特征阻抗，它不是直流电阻，属于长线传输中的概念。特性阻抗是射频传输线影响无线电波电压、电流的幅值和相位变化的固有特性，等于各处的电压与电流的比值，用V/I表示。在射频电路中，电阻、电容、电感都会阻碍交变电流的流动，合称阻抗。电阻是吸收电磁能量的，理想电容和电感不消耗电磁能量。
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AXI是一种总线协议，该协议是ARM公司提出的AMBA3.0协议中最重要的部分，是一种面向高性能、高带宽、低延迟的片内总线。它的地址/控制和数据相位是分离的，支持不对齐的数据传输，同时在突发传输中，只需要首地址，同时分离的读写数据通道、并支持Outstanding传输访问和乱序访问，并更加容易进行时序收敛。AXI是AMBA中一个新的高性能协议。
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