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fpga设计

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FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。

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fpga设计技术

FPGA设计中的模块化设计

模块化设计是FPGA设计中一个很重要的技巧，它能够使一个大型设计的分工协作、仿真测试更加容易，代码维护或升级也更加便利。

2023-10-07 标签：FPGA设计 CLK 1432 0

如何FPGA内部的RAM进行读改写操作

存储器是FPGA设计中的常用单元，对存储器的操作，最基础的就是读写操作，还有一种就是读改写操作，即先读出存储器中的数据，对其进行修改后，再写入存储器。这...

2023-09-28 标签：fpga FPGA设计存储器 2344 0

做好FPGA设计需要掌握哪些知识

成为一名说得过去的FPGA设计者，需要练好5项基本功：仿真、综合、时序分析、调试、验证。

2023-09-28 标签：fpga FPGA设计仿真 835 0

如何脱离Vivado建立单独仿真环境软件呢？

FPGA项目开发的过程中，需要完成设计代码开发、验证环境搭建、仿真分析、板级验证等操作，在这个过程中，许多操作虽然必不可少但是步骤是重复的。

2023-09-27 标签：fpga FPGA设计仿真 1217 0

降低时序报告中逻辑延迟的方法

在FPGA逻辑电路设计中，FPGA设计能达到的最高性能往往由以下因素决定。

2023-09-26 标签：fpga 逻辑电路 FPGA设计 1538 0

FPGA浮点IP内核究竟有哪些优势呢？

最近出现的 FPGA设计工具和 IP有效减少了计算占用的资源，大大简化了浮点数据通路的实现。而且，与数字信号处理器不同

2023-09-25 标签：dsp FPGA设计乘法器 653 0

求一种基于FPGA时间数字转换(TDC)设计方案

时间数字转换(Time-to-Digital Converter,TDC)是一种用来测量时间的电路，它将连续的时间信号转换为数字信号，从而实现时间测量的数字化。

2023-09-22 标签：fpga FPGA设计寄存器 3250 0

BGA如何快速在4个Ball之间均匀布孔扇出呢？

BGA扇出是EDA工程师的一项基本功，在布局完成后，先将BGA的Ball进行打孔扇出，然后分层和4个方向将BGA内部信号线引出到外部空间

2023-09-22 标签：PCB板 FPGA设计 BGA封装 4667 0

如何实现一种基于FPGA全数字高码率QPSK调制设计？

调制信号的符号速率达到500Mbps，根据奈奎斯特采样定理，DA的采样频率采用2Gbps。

2023-09-22 标签：滤波器 FPGA设计调制解调器 1915 0

基于单光子探测的时间相关计数TCSPC设计实现

TCSPC时间相关单光子计数技术是一种成熟且通用的单光子计数技术，是一种功能强大的分析方法，目前广泛应用于荧光寿命测量、时间分辨光谱、荧光寿命成像、飞行...

2023-09-22 标签：FPGA设计存储器数字转换器 6195 3

用Verilog在FPGA上实现低通滤波器

在本文中，我们将简要介绍不同类型的滤波器，然后学习如何实现移动平均滤波器并使用CIC架构对其进行优化。

2023-10-02 标签：FPGA设计低通滤波器加法器 2500 0

Mojo v3 FPGA板与16x2 LCD模块是如何进行连接的呢？

在本教程中，我们将使用Verilog HDL设计一个数字电路，该电路与基于HD44780 LCD控制器/驱动芯片的通用LCD模块连接。Mojo V3 F...

2023-09-20 标签：FPGA设计 LCD控制器多路复用器 864 0

怎样使用Verilator进行Verilog Lint呢？

FPGA设计是无情的，所以我们需要利用能获得的任何软件进行检查

2023-09-20 标签：FPGA设计仿真器 SDL 1707 0

FPGA设计中的亚稳态解析

说起亚稳态，首先我们先来了解一下什么叫做亚稳态。亚稳态现象：信号在无关信号或者异步时钟域之间传输时导致数字器件失效的一种现象。

2023-09-19 标签：fpga FPGA设计信号 1787 0

如何使用Verilog硬件描述语言描述时序逻辑电路？

时序逻辑电路的特点是输出信号不仅与电路的输入有关，还与电路原来的状态有关。

2023-09-17 标签：FPGA设计反相器 D触发器 2631 0

vivado主界面及设计流程

Vivado设计主界面，它的左边是设计流程导航窗口，是按照FPGA的设计流程设置的，只要按照导航窗口一项一项往下进行，就会完成从设计输入到最后下载到开发...

2023-09-17 标签：FPGA设计寄存器 TCL 2746 0

为什么说Vivado是基于IP的设计？

Vivado是Xilinx公司2012年推出的新一代集成开发环境，它强调系统级的设计思想及以IP为核心的设计理念，突出IP核在数字系统设计中的作用。

2023-09-17 标签：FPGA设计寄存器 C语言 1864 0

介绍一种IP控制信号的处理方式

在ASIC/FPGA项目中，我们会用到很多IP，其中有很多IP存在内部控制信号以及内部状态信号。

2023-09-15 标签：fpga 控制器 FPGA设计 1299 0

FPGA设计存在的4类时序路径

命令set_multicycle_path常用来约束放松路径的约束。通常情况下，这种路径具有一个典型的特征：数据多个周期翻转一次，如下图所示。因此，我们...

2023-09-14 标签：fpga FPGA设计命令 911 0

请问如何将C语言算法移植到FPGA上？

确定算法：首先，你需要确保要移植的C语言算法是合适的。FPGA适合并行计算和高度可定制的应用。因此，你需要选择一个适合FPGA实现的算法。

2023-09-12 标签：FPGA设计 VHDL语言 C语言 1780 0

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