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FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。

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fpga设计技术

Xilinx FPGA AXI4总线（二）用实例介绍5个读写通道

AXI4协议是一个点对点的主从接口协议，数据可以同时在主机（Master）和从机（Slave）之间**双向** **传输** ，且数据传输大小可以不同。

2023-06-21 标签：FPGA设计 FIFO存储 BRAM 3310 0

Xilinx FPGA AXI4总线（一）介绍【AXI4】【AXI4-Lite】【AXI-Stream】

从 FPGA 应用角度看看 AMBA 总线中的 AXI4 总线。

2023-06-21 标签：控制器 FPGA设计 DDR 2219 0

FPGA仿真必备—Matlab生成.mif/.txt/.coe文件

.mif 和 .coe 是 FPGA 设计中常用的存储文件，用于 ROM、RAM 等存储器数据的加载，常见的还用在 DDS 信号发生器和 FIR 滤波器...

2023-06-21 标签：FPGA设计存储器 DDS 5410 0

CDC跨时钟域处理及相应的时序约束

CDC（Clock Domain Conversion）跨时钟域分单bit和多bit传输

2023-06-21 标签：FPGA设计 RAM CDC 1721 0

如何正确使用in_system_ibert呢？

对应的IP端口处也会出现相应的端口，例如上图选择了2个Quad，也就是8个通道的串行收发器，那么对应的drp接口就有8个。

2023-06-21 标签：收发器 FPGA设计串行收发器 1061 0

讲解几点关于FIFO IP核使用时的注意事项

FIFO？还是FIFO IP核？这也需要写总结吗？太容易了吧。如果我是一个正在处于面试找工作中的年轻人，肯定关注的是如何手撕FIFO，这也是当时校招时候...

2023-06-21 标签：FPGA设计寄存器 RAM 1376 0

Xilinx的高质量时钟输出ODDR原语

在SDR接口中，ODDR转发时钟（仍在时钟树内），输出端要直连到输出port，不可加逻辑，连接方式：输出时钟连接ODDR的C引脚，D1固定值1&apos...

2023-06-21 标签：FPGA设计 SDR RTL 1449 0

ZC706评估板IBERT误码率测试和眼图扫描

IBERT（Integrated Bit ErrorRatio Tester，集成误比特率测试工具），是Xilinx提供用于调试FPGA高速串行接口比特...

2023-06-21 标签：收发器 FPGA设计寄存器 3739 0

关于行为仿真的一点观点

仿真是为了仿真，所以不要设置极限情况，例如在时钟上升沿通过阻塞赋值给数据，应该避免这种情况；

2023-06-21 标签：FPGA设计仿真器 Vivado 468 0

FPGA设计心得之Aurora IP核例子简析与仿真

FLow Control 暂时选择为None。（有必要后面专门研究，暂时最主要的还是弄懂用户接口信号的用法！）

2023-06-21 标签：FPGA设计移位寄存器状态机 1635 0

你真的会Xilinx FPGA的复位吗？

对于复位信号的处理，为了方便我们习惯上采用全局复位，博主在很长一段时间内都是将复位信号作为一个I/O口，通过拨码开关硬件复位。

2023-06-21 标签：FPGA设计触发器状态机 1144 0

不得不读的Xilinx FPGA复位策略

尽量少使用复位，特别是少用全局复位，能不用复位就不用，一定要用复位的使用局部复位；

2023-06-21 标签：FPGA设计微处理器触发器 2422 0

乘法器的Verilog HDL实现方案

两个N位二进制数x、y的乘积用简单的方法计算就是利用移位操作来实现。

2023-06-21 标签：FPGA设计 HDL 乘法器 1077 0

怎么通过捣鼓FPGA板把数码管给点亮并显示有效信息？

今天我们任务是通过小脚丫板载的两个数码管来显示字符，所以首先我们要了解一下数码管的基本工作原理，接下来再研究怎么通过捣鼓小脚丫把数码管给点亮，并且显示出...

2023-06-20 标签：FPGA设计 led灯数码管 1114 0

通过小脚丫FPGA核心开发板来进行门电路的设计

在数字电路中，门电路是最基本的构成单位，可以说，任何复杂的数字电路系统都可以通过我们耳熟能详的与门，非门，或门，与非门，异或门等等组合实现。

2023-06-20 标签：FPGA设计 led灯 MOS管 1198 0

简易FM信号解调的FPGA实现过程讲解

FM解调需要去掉载波得到基带的信号，考虑到FM的特殊性，使用参考资料1中的小角度近似解调算法

2023-06-20 标签：滤波器 FPGA设计正弦波 4033 0

介绍FPGA在线调试的一大利器—VIO

之前的文章介绍了FPGA在线调试的方法，包括选定抓取信号，防止信号被优化的方法等等。

2023-06-20 标签：FPGA设计 DDS 触发器 6619 0

FPGA纯verilog编解码SDI实现流程

一是使用专用编解码芯片，比如典型的接收器GS2971，发送器GS2972，优点是简单，比如GS2971接收器直接将SDI解码为并行的YCRCB，GS29...

2023-06-19 标签：FPGA设计 DDR3 接收器 1768 0

FPGA在线调试的方法简单总结

Xilinx被AMD收购的事情把我震出来了，看了看上上一篇文章讲了下仿真的文件操作，这篇隔了很久远，不知道该从何讲起，就说说FPGA的在线调试的一些简单...

2023-06-19 标签：FPGA设计 RTL AXI总线 1955 0

多片FPGA原型验证的限制因素有哪些？

当SoC系统的规模很大的时候，单片FPGA验证平台已经无法容纳这么多容量，我们将采取将SoC设计划分为多个FPGA的映射。

2023-06-19 标签：FPGA设计连接器 TDM 683 0

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