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fpga设计

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FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。

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fpga设计技术

什么是同步有限状态机？为什么要用状态机？怎么表示状态机？

同步：所有的状态跳转都是在时钟的作用下进行

2023-07-17 标签：FPGA设计有限状态机状态机 1774 0

基于FPGA的AES256光纤加密设计案例实现

近年来，信息安全应用于生活中的各个领域.在光通信系统中，往往对速率有着较高的追求。其中对光模块，光纤通信中的传输算法，传输的模式以及光波段选取有密切关联。

2024-05-10 标签：FPGA 收发器 FPGA设计 1767 0

怎么使用MATLAB进行O-RAN小基站建模和仿真？

开放式无线接入网（Open Radio Access Network，简称 O-RAN）是一种无线接入网 (RAN)。

2023-06-14 标签：matlab FPGA设计 PHY 1765 0

利用硬件辅助工具加速芯片前端设计的功能性验证阶段

软件仿真(Simulation)，FPGA原型验证(FPGA Based Prototyping)和硬件仿真加速(Emulation)这三种有效的功能验...

2022-10-10 标签：FPGA设计 RTL AHB总线 1763 0

FPGA速度-面积互换原则设计

速度-面积互换原则是贯穿FPGA设计的重要原则：速度是指工程稳定运行所能达到的最高时钟频率，通常决定了FPGA内部寄存器的运行时序；面积是指工程运行所消...

2023-06-09 标签：fpga FPGA设计寄存器 1755 0

FIFO IP核报Memory Collision Error on RAMB36E1解决方案

以前很少用到仿真，这次在仿真的过程中，遇到了某个警告，于是转过头又去研究了FIFO中的Safety Circuit的作用。

2023-06-19 标签：FPGA设计 RAM FIFO存储 1754 0

异步复位异步释放会有什么问题？FPGA异步复位为什么要同步释放呢？

一般来说，复位信号有效后会保持比较长一段时间，确保 register 被复位完成。但是复位信号释放时，因为其和时钟是异步的关系，我们不知道它会在什么时刻被释放。

2024-01-24 标签：FPGA设计状态机 FDR 1751 0

降低时序报告中逻辑延迟的方法

在FPGA逻辑电路设计中，FPGA设计能达到的最高性能往往由以下因素决定。

2023-09-26 标签：fpga 逻辑电路 FPGA设计 1750 0

ASIC和FPGA到底选哪个好？两者的流程有什么区别？

ASIC (Application Specific Integrated Circuit)，即专用集成电路，是指应特定用户要求和特定电子系统的需要而设...

2023-09-02 标签：FPGA设计存储器 ASIC芯片 1745 0

详细讨论SERDES用到的各种关键技术

随着大数据的兴起以及信息技术的快速发展，数据传输对总线带宽的要求越来越高，并行传输技术的发展受到了时序同步困难、信号偏移严重，抗干扰能力弱以及设计复杂度...

2023-05-10 标签：收发器滤波器 FPGA设计 1745 0

FPGA设计心得之Aurora IP核例子简析与仿真

FLow Control 暂时选择为None。（有必要后面专门研究，暂时最主要的还是弄懂用户接口信号的用法！）

2023-06-21 标签：FPGA设计移位寄存器状态机 1735 0

简易AM信号调制的FPGA实现过程简单讲解

首先，为什么是AM信号的调制过程，是因为在短时间情况下，AM信号的实现相对简单，而且上述提到的几个模块都可以得到使用和验证。

2023-06-06 标签：AGC FPGA设计 ROM 1734 0

从处理单bit跨时钟域信号同步问题来入手

在数字电路中，跨时钟域处理是个很庞大的问题，因此将会作为一个专题来陆续分享。今天先来从处理单bit跨时钟域信号同步问题来入手。

2023-06-27 标签：FPGA设计 IC设计仿真器 1733 0

如何使用fpga实现数字基带中环路延时估计

基于FPGA芯片Stratix II EP2S60F672C4设计实现了数字基带预失真系统中的环路延迟估计模块。该模块运用了一种环路延迟估计新方法，易于...

2018-12-19 标签：fpga FPGA设计 1727 0

如何在FPGA上快速搭建以太网？

LWIP 是使用裸机设计以太网的良好起点，在此基础上我们可以轻松调整软件应用程序以提供更详细的应用程序。LWIP Echo 服务器的使用首先使我们能够确...

2023-09-08 标签：fpga FPGA设计以太网 1726 0

在模块化设计过程中编写testbench并仿真的方法介绍

在开始设计前，根据设计划分好各功能模块（为了叙述方便，这里以对“FPGA数字信号处理（十三）锁相环位同步技术的实现”中设计的系统仿真为例）。

2023-09-04 标签：锁相环 FPGA设计仿真器 1725 0

FPGA设计衍生时钟约束和时钟分组约束设置

FPGA设计中，时序约束对于电路性能和可靠性非常重要。

2023-06-26 标签：FPGA设计时序约束 Vivado 1722 0

Vivado中设计锁定与增量编译方法简析

增量实现由两个流程构成：原始流程和增量流程，如图所示。其中，原始流程提供网表。

2022-10-10 标签：FPGA设计 RAM DCP 1719 0

按键抖动消除verilog设计

按键作为一种机械开关，在进行按键操作时，机械接触点的弹性及电压突变等原因，在机械开关合闭的时候会出现电压抖动，因此在实际的应用当中需要做一定的处理。

2023-04-27 标签：FPGA设计触发器 FPGA芯片 1705 0

Xilinx的高质量时钟输出ODDR原语

在SDR接口中，ODDR转发时钟（仍在时钟树内），输出端要直连到输出port，不可加逻辑，连接方式：输出时钟连接ODDR的C引脚，D1固定值1&apos...

2023-06-21 标签：FPGA设计 SDR RTL 1699 0

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特性阻抗又称特征阻抗，它不是直流电阻，属于长线传输中的概念。特性阻抗是射频传输线影响无线电波电压、电流的幅值和相位变化的固有特性，等于各处的电压与电流的比值，用V/I表示。在射频电路中，电阻、电容、电感都会阻碍交变电流的流动，合称阻抗。电阻是吸收电磁能量的，理想电容和电感不消耗电磁能量。
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