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标签 > fpga设计
FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。
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FIFO IP核报Memory Collision Error on RAMB36E1解决方案
以前很少用到仿真，这次在仿真的过程中，遇到了某个警告，于是转过头又去研究了FIFO中的Safety Circuit的作用。
首先需要把FIR最基本的结构实现，也就是每个FIR抽头的数据与其抽头系数相乘这个操作。由顶层文件对这个基本模块进行多次调用。
由于以太网测试使用的开发板是淘宝购买的某款开发板，开发人员在电路设计时没有考虑到将以太网芯片的接收时钟、发送时钟通过FPGA的专用时钟管脚接入到到全局时钟网络
FPGA内部表示正负数，小数的规则。两者相比之下，定点数实现简单，表达更为直观，所以在很多时候FPGA通常使用定点数表示小数。
在芯片功能验证中，仿真波形一直是调试的重要手段。通过观测分析波形，工程师可以推断代码是否正常运行，电路的功能是否正确，设计是否满足预期。
定点数硬件实现简单，但表示的范围有限，且部分的小数运算IP核只支持浮点数运算，因此这里还需要提到浮点数的相关内容。
根据《通信原理》一书可知，m序列是最长线性反馈移位寄存器的简称，它产生的伪随机序列的周期与其反馈移存器级数有关;
OSERDES实现并串转换，只需要管发送并不需要管接收到的数据如何，所以它的操作相对于ISERDES来说简单；
高速信号传输过程中，并行传输因为线路同步难，抗干扰性差等缺点逐渐被串行技术取代；通过提高传输速率的方法，串行传输也可以实现很高的传输速度。
在高速信号采集的过程中，经常会因为电路设计或者其他原因，原本设计好对应的data_clk与data经过线路传输之后在接收端时序上不能很好的对应，这可能会...
最近调试芯片遇到一个选择题，需要决定数据接口的接口标准，是选用LVDS差分接口还是CMOS单端接口。
滤波器是一种用来减少，消除干扰的电器部件，有对特定频率的频点或该频点以外的频率信号进行有效滤除，从而实现消除干扰、获取特定频率信号的功能。
这种方法是通过将模拟滤波器频率特性H(s)反拉氏变换为h(t)，再将h(t)等间隔抽样成h(n)后，对h(n)取Z变换求得H(z)，即得到了数字滤波器的...
开放式无线接入网（Open Radio Access Network，简称 O-RAN）是一种无线接入网 (RAN)。
因为CNN的特有计算模式，通用处理器对于CNN实现效率并不高，不能满足性能要求。 因此，近来已经提出了基于FPGA，GPU甚至ASIC设计的各种加速器来...
FIFO 是FPGA设计中最有用的模块之一。FIFO 在模块之间提供简单的握手和同步机制，是设计人员将数据从一个模块传输到另一个模块的常用选择。
在FPGA设计中，时序约束对于电路性能和可靠性非常重要。在上一篇的文章中，已经详细介绍了FPGA时序约束的主时钟约束。
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