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FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。

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FPGA设计与应用之基于AD9833芯片的信号发生器设计

2019-03-26 标签：FPGA设计 DDS芯片状态机 1555 0

FPGA，你为什么这么牛？

2018-07-02 标签：fpga FPGA设计 152 0

FPGA，你为什么这么牛？

2018-07-02 标签：fpga FPGA设计 102 0

震撼！FPGA实现负反馈控制纯数字锁相环！

2018-03-07 标签：FPGA设计 418 0

全硬件TCP/IP协议栈学习笔记（第八天：W5500+FPGA实现tcp连接）

经历了一个多月的调试，最终终于使用basys2将tcp模式配置成功了。首先说一下思路吧，首先W5500的发送与接收与开发板的通信使用的是SPI协议，下...

2017-12-18 标签：FPGA设计 tcp 1.1万 0

全硬件TCP/IP协议栈学习笔记（第七天：FPGA+W5500 PING通）

在一周多的时间，从软件的协议到芯片接口最后到硬件描述，我觉得是时候试一试芯片了，看一看能不能ping通。两天时间终于完成第一次ping，也挺不容易的。 ...

2017-12-18 标签：FPGA设计 tcp 9005 0

全硬件TCP/IP协议栈学习笔记（第六天：SPI通信协议学习一）

今天我们学习一下W5500使用的通讯接口，SPI协议。SPI，中文串行外围设备接口，SPI总线是在物理上是通过接在外围设备微控制单元上的同步串行端口的模...

2017-12-18 标签：FPGA设计 5170 0

全硬件TCP/IP协议栈学习笔记（第五天：全硬件TCP/IP协议应用层学习）

继续昨天的设置端口TX/RX存储信息，每个端口的基地址和屏蔽地址在这里确定并保存。W5500有一个通用寄存器，8个Socket寄存器去，以及对应每个S...

2017-12-18 标签：FPGA设计 4736 0

FPGA设计的基本原则、技巧与时序电路设计

FPGA设计的基本原则面积与速度折衷原则面积和速度是ASIC芯片设计中一对相互制约、影响成本和性能的指标，贯穿FPGA设计的始终。在FPGA设计中，...

2017-11-25 标签：FPGA设计 1115 0

图像自适应分段线性拉伸算法的FPGA设计

由于红外图像的成像机理以及红外成像自身的原因，红外图像有对比度低、图像较模糊、噪声大等特点。因此抑止噪声，提高图像信噪比，以及调整红外图像对比度，以利于...

2017-11-25 标签：FPGA设计 1021 0

通过一个实例具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束

摘要：本文主要通过一个实例具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束，主要涉及到的约束包括时钟约束、群组约束、逻辑管脚约束以及物理属性约...

2017-11-25 标签：fpga FPGA设计 ise 5381 0

成功解决FPGA设计时序问题的三大要点

FPGA的设计与高速接口技术可以帮助你满足今天的市场要求，但也提出了一些有趣的设计挑战。为了确保存储器接口的数据传输准确，在超过200兆赫兹以上，进行时...

2017-11-25 标签：FPGA设计 1213 0

基于FPGA设计时效仿真技术的验证以及其应用

随着FPGA器件体积和复杂性的不断增加，设计工程师越来越需要有效的验证方。时序仿真可以是一种能发现最多问题的验证方法，但对许多设计来说，它常常是最困难...

2017-11-24 标签：fpga FPGA设计时效仿真 1285 0

关于FPGA设计的验证技术及其应用原则分析和介绍

FPGA设计和验证工程师当今面临的最大挑战之一是时间和资源制约。随着FPGA在速度、密度和复杂性方面的增加，完成一个完整时序验证对人力和计算机处理器、存...

2019-10-06 标签：FPGA设计存储器时序 1253 0

基于FPGA设计环境中加时序约束的详细分析与优化结果

在给FPGA做逻辑综合和布局布线时，需要在工具中设定时序的约束。通常，在FPGA设计工具中都FPGA中包含有4种路径：从输入端口到寄存器，从寄存器到寄存...

2017-11-24 标签：fpga FPGA设计时序约束 1683 0

具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束

本文主要通过一个实例具体介绍ISE中通过编辑UCF文件来对FPGA设计进行约束，主要涉及到的约束包括时钟约束、群组约束、逻辑管脚约束以及物理属性约束。 ...

2017-11-24 标签：fpga FPGA设计 3502 0

FPGA设计中的时序问题的详细分析与解决方案

耗费数月精力做出的设计却无法满足时序要求，这确实非常令人伤心。然而，试图正确地对设计进行约束以保证满足时序要求的过程几乎同样令人费神。找到并确定时序约束...

2017-11-24 标签：fpga FPGA设计时序问题 9984 0

基于赛灵思FPGA设计的整体时序具有完全可重复性

满足设计的时序要求本身已非易事，而要实现某项设计的整体时序具有完全可重复性有时候却是不可能的任务。幸运的是，设计人员可以借助有助于实现可重复时序结果的...

2017-11-24 标签：fpga FPGA设计可重复时序 796 0

直接扩频通信同步系统的xilinx FPGA设计原理分析

对直接扩频通信同步系统进行了研究，使用PN码作为扩频序列，利用其良好的自相关性，提出一种新式的滑动相关法使收发端同步，并给出该系统的FPGA实现方法...

2017-11-24 标签：fpga FPGA设计通信 1349 0

利用MCU和FPGA设计车载信息娱乐系统的系统架构与应用

汽车工业蓬勃发展，车载信息娱乐系统已经不再是豪华轿车的独有设施，越来越多的中低端轿车开始拥有自己的信息娱乐系统。然而，车载信息娱乐系统是一个高度集成的复...

2017-11-24 标签：fpga mcu FPGA设计 1760 0

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为防止静电积累所引起的人身电击、火灾和爆炸、电子器件失效和损坏，以及对生产的不良影响而采取的防范措施。其防范原则主要是抑制静电的产生，加速静电泄漏，进行静电中和等。
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ArduBlock软件是Arduino官方编程环境的第三方软件，目前必须依附于Arduino软件下运行，区别于Arduino文本式编程环境，ArduBlock是以图形化积木搭建的方式编程的，这样的方式会使编程的可视化和交互性加强，编程门槛降低，即使没有编程经验的人也可以尝试给Arduino控制器编写程序。
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特性阻抗又称特征阻抗，它不是直流电阻，属于长线传输中的概念。特性阻抗是射频传输线影响无线电波电压、电流的幅值和相位变化的固有特性，等于各处的电压与电流的比值，用V/I表示。在射频电路中，电阻、电容、电感都会阻碍交变电流的流动，合称阻抗。电阻是吸收电磁能量的，理想电容和电感不消耗电磁能量。
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AXI是一种总线协议，该协议是ARM公司提出的AMBA3.0协议中最重要的部分，是一种面向高性能、高带宽、低延迟的片内总线。它的地址/控制和数据相位是分离的，支持不对齐的数据传输，同时在突发传输中，只需要首地址，同时分离的读写数据通道、并支持Outstanding传输访问和乱序访问，并更加容易进行时序收敛。AXI是AMBA中一个新的高性能协议。
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时钟源用来为环形脉冲发生器提供频率稳定且电平匹配的方波时钟脉冲信号。它通常由石英晶体振荡器和与非门组成的正反馈振荡电路组成，其输出送至环形脉冲发生器。
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　　AD转换采样频率指完成一次从模拟转换到数字的AD转换所需时间的倒数，模拟量可以是电压、电流等电信号，也可以是压力、温度、湿度、位移、声音等非电信号；而AD分辨率指数字量变化一个最小量时模拟信号的变化量。
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