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浅谈STM32单片机的时钟系统

　　今天来总结一下stm32单片机的时钟系统，也就是时钟树的相关知识点。单片机正常工作的三要素是电源、时钟、复位电路。由此可以说，时钟的正常工作是单片机...

2023-06-12 标签：单片机 STM32 pll 1846 0

一种FLL辅助PLL的GNSS接收机矢量跟踪环路

摘要：全球导航卫星系统（GNSS）接收机的设计主要包括捕获、跟踪、解算三个环节，其中，跟踪环节中载波频率和码频率的稳定性直接影响着导航定位性能。为改...

2022-10-27 标签：接收机 pll GNSS 1806 0

单芯片直接数字频率合成与模拟PLL的比较

新的集成完整DDS产品为敏捷频率合成应用提供了一种有吸引力的模拟PLL替代方案。长期以来，直接数字频率合成（DDS）一直被认为是生成高精度、频率捷变...

2023-01-30 标签：处理器 pll DDS 1800 0

FPGA的时钟电路结构原理

FPGA 中包含一些全局时钟资源。以AMD公司近年的主流FPGA为例，这些时钟资源由CMT（时钟管理器）产生，包括DCM、PLL和MMCM等。

2024-04-25 标签：FPGA 锁相环 pll 1792 0

为什么串行接口速率比并行接口快？

以PCIE和SATA为例，时钟信息通过8b/10b编码已经集成在数据流里面，数据本身经过加扰，不可能有多于5个0或者5个1的长串（利于时钟恢复），也不存...

2023-06-06 标签：数据 pll 编码 1735 0

宽带低误差矢量幅度(EVM)直接变频发射机原理图

本电路为宽带直接变频发射机模拟部分的完整实现方案（模拟基带输入、RF输出）。通过使用锁相环（PLL）和宽带集成电压控制振荡器（VCO），本电路支持500...

2013-11-06 标签：ADI PLL VCO 1688 0

下一代软件定义无线电收发器在跳频方面取得巨大进步

本文深入讨论了跳频（FH）的高级概念、通过ADRV9002 SDR收发器的灵活锁相环（PLL）架构实现的跳频设计原理及其四个主要跳频特性。这些功能使用户...

2022-12-09 标签：收发器 pll 无线电 1682 0

为什么退耦电容通常选100nF呢？

这个问题其实...说白了主要是大家都在用，或者说大部分时候it works。

2023-05-26 标签：pll 电源完整性退耦电容 1670 0

锁相环路锁定状态的条件及类型

基本锁相环通常由锁相检测器（Phase Detector）、低通滤波器（Loop Filter）和令牌圈振荡器（VCO）组成。它是最简单的锁相环形式，用...

2024-01-31 标签：锁相环低通滤波器 pll 1669 0

关于相位锁定环(PLL)频率合成器的设计和分析

本篇文章是关于相位锁定环(PLL)频率合成器的设计和分析，重点讨论了相位噪声和频率噪声的测量、建模和仿真方法。文章以设计一个假想的PLL频率合成器为例，...

2023-10-26 标签：锁相环频率合成器仿真 1668 0

DFT如何产生PLL 测试pattern

DFT PLL向量，ATE怎么用？自动测试设备（ATE）对PLL（锁相环）进行测试时，我们首先要明白PLL在系统级芯片（SoC）中的重要性。它是SoC...

2023-10-30 标签：芯片测试 IC 1664 0

使用低压差分信号LVDS进行高速信号分配

时钟分配在数字系统中非常重要，因为数字系统需要不同的子系统使用相同的时钟参考。例如，在大多数情况下，基站的DSP部分必须与射频信号处理部分同步，锁相环（...

2023-03-29 标签：dsp 振荡器 pll 1655 0

如何使用部分PLL创建调制波形

如果您遇到需要随时间变化扫描频率的情况，可以考虑雷达等应用，在这类应用中发送的信号不仅可由目标反射回来，而且还能够与接收到的信号进行比较。观察频率（D...

2016-01-18 标签：PLL 调制波形波形斜率 1649 1

LDO基础知识：电源抑制比

低压差线性稳压器（LDO）最大的优点之一是它们能够衰减开关模式电源产生的电压纹波。这对锁相环（PLL）和时钟等信号调节器件在内的数据转换器尤为重要，因为...

2023-04-04 标签：电源稳压器 LDO 1644 0

JESD204B链路中断时的基本调试技巧

本文旨在提供发生 JESD204B 链路中断情况下的调试技巧简介

2023-07-10 标签：仿真 pll 时钟 1628 0

如何正确应用FPGA的四种时钟资源？

把握DCM、PLL、PMCD和MMCM知识是稳健可靠的时钟设计策略的基础。赛灵思在其FPGA中提供了丰富的时钟资源，大多数设计人员在他们的FPGA设计中...

2023-10-30 标签：fpga 赛灵思 pll 1628 0

收发器相位噪声拆解通过外部LO提供性能

ADI公司ADRV9009收发器使用外部本振（LO）时的测量表明，使用低噪声LO时，相位噪声可以显著改善。收发器架构是从相位噪声贡献的角度提出的。通过一...

2022-12-21 标签：集成电路收发器 pll 1626 0

设计带有新型宽带整数N分频PLL频率合成器的直接6GHz本振

频率合成器ADF4106（图1）可用于在无线接收器和发射器的上变频和下变频部分实现本振（LO）。它由一个低噪声数字鉴频鉴频器（PFD）、一个精密电荷泵、...

2023-02-02 标签：频率合成器 pll 计数器 1574 0

什么是锁相环锁相环系统的三个模块组成

最基础的锁相环系统主要包含三个基本模块：鉴相器（Phase Detector：PD）、环路滤波器（L00P Filter：LF）其实也就是低通滤波器，和...

2023-09-03 标签：锁相环低通滤波器 STM32 1564 0

适用于16位2.5Gsps高性能DAC的不折不扣的时钟解决方案

LTC®2000 16 位 2.5Gsps DAC 提供了卓越的交流性能。对于许多DAC应用，相位噪声、噪声频谱密度（NSD）和无杂散动态范围（SFDR...

2023-01-05 标签：dac pll 信号发生器 1561 0

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IoT是Internet of Things的缩写，字面翻译是“物体组成的因特网”，准确的翻译应该为“物联网”。物联网（Internet of Things）又称传感网，简要讲就是互联网从人向物的延伸。
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STM32F103C8T6是一款集成电路，芯体尺寸为32位，程序存储器容量是64KB，需要电压2V~3.6V，工作温度为-40°C ~ 85°C。
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数字隔离技术常用于工业网络环境的现场总线、军用电子系统和航空航天电子设备中，尤其是一些应用环境比较恶劣的场合。数字隔离电路主要用于数字信号和开关量信号的传输。另一个重要原因是保护器件（或人）免受高电压的危害。本文详细介绍了数字隔离器工作原理及特点，选型及应用，各类数字隔离器件性能比较等内容。
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