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全网最实用的Verdi教程1

Verdi是一个功能强大的debug工具，可以配合不同的仿真软件进行debug，很多企业常用VCS+Verdi或者Xcelium/xrun+Verdi的...

2023-05-05 标签：VCS Verdi 芯片验证 1.6万 0

VCS编译选项：-y及+libext+

VCS是一款常见的Verilog编译工具，它提供很多编译选项来控制编译过程及其输出。本文主要介绍以下两个编译选项。

2023-05-29 标签：模块 Verilog VCS 1.1万 0

基于linux系统实现的vivado调用VCS仿真教程

在linux系统上实现vivado调用VCS仿真教程作用：vivado调用VCS仿真可以加快工程的仿真和调试，提高效率。前期准备：确认安装vivad...

2018-07-05 标签：linux系统 vcs vivado 1.1万 1

简单讲解AXI Interconnect IP核的使用方法

最近需要用到AXI接口的模块，xilinx的IP核很多都用到了AXI总线进行数据和指令传输。如果有多个设备需要使用AXI协议对AXI接口的BRAM进行读...

2023-06-19 标签：控制器 RTL VCS 9576 0

vcs学习笔记(常用选项/仿真流程/代码覆盖率/综合后仿真/图一乐技巧)

VCS是编译型verilog仿真器，VCS先将verilog/systemverilog文件转化为C文件，在linux下编译生成的可执行文./simv即...

2022-05-23 标签：Linux 仿真器 Verilog 9223 0

vcs和verdi的调试及联合仿真案例

若想用Verdi观察波形，需要在仿真时生成fsdb文件，而fsdb在vcs或者modelsim中的生成是通过两个系统调用$fsdbDumpfile $f...

2020-09-22 标签：服务器波形 VCS 8525 0

全网最实用的Verdi教程2

Verdi是一个功能强大的debug工具，可以配合不同的仿真软件进行debug，很多企业常用VCS+Verdi或者Xcelium/xrun+Verdi的...

2023-05-05 标签：VCS Verdi 芯片验证 8029 0

启用负时序检查的步骤

检查时序窗口的稳定性，包括：setup、hold、setuphold、recovery、removal和recrem。

2022-10-19 标签：寄存器 VCS 时钟信号 6513 0

如何用vcs+verdi仿真Verilog文件并查看波形呢？

我们以一个简单的加法器为例，来看下如何用vcs+verdi仿真Verilog文件并查看波形。

2023-05-08 标签：Verilog 加法器 VCS 6273 0

vcs和xrun搭配uvm1.1/uvm1.2版本库的使用情况

我们在项目中有时候需要使用不同的UVM版本库进行仿真，有时候还会在不同的仿真器之间进行切换，本文简单总结了一下vcs和xrun搭配uvm1.1/uvm1...

2023-10-27 标签：仿真器 UVM VCS 3758 0

VCS仿真软件的基本使用方式

在之前的博文中谈到过GVIM编辑器中可以通过调用模板来生成重复性代码，但没有介绍自定义模板的方式。

2022-08-10 标签：VCS 代码仿真软件 3660 0

systemverilog中的assertion用法整理

时序电路讲究建立时间、保持时间需要留有裕量。这也说明了，在电路中信号的顺序以及之间的时序关系十分重要。

2023-06-06 标签：Verilog 时序电路 VCS 3634 0

以xa-vcs为例如何进行cosim仿真验证？

**1 ** 层级关系曾经我一直认为cosim最顶层必须是一个数字顶层，其实不然。具体使用哪个做顶层要看项目，以数字为顶层的好处是，模拟仿真的结果都转...

2023-10-31 标签：EDA工具加法器电平转换 3609 0

浅谈VCS的两种仿真flow

几乎所有的芯片设计、芯片验证工程师，每天都在和VCS打交道，但是由于验证环境的统一化管理，一般将不同的编译仿真选项集成在一个文件里，只需要一两个人维护即...

2023-01-10 标签：仿真 Verilog vhdl 3538 0

Verdi环境配置、生成波形的方法

Verdi是一个功能强大的debug工具，可以配合不同的仿真软件进行debug，很多企业常用的就是VCS+Verdi或或者Xcelium(xrun)+V...

2023-05-29 标签：IC设计 EDA工具 VCS 3433 0

使用VCS观察Verilog二维数组仿真值的方法

FIR设计过程中，不可避免使用到reg/wire的二维数组；

2023-06-06 标签：FIR Verilog VCS 3297 0

VCS/XRUN如何创建一个非UVM的简单仿真环境？

设计码完代码后，有时候想简单调试一下基本的通路，此时还没有验证资源进来，可以仿照modesim仿真的方法，创建一个.v/.sv的顶层，里面例化DUT，里...

2023-05-12 标签：仿真 UVM VCS 3226 0

用VCS跑simulation hang住了该怎么办？

遇到此类问题，我第一个想到的是去打印一些log看看，比如设置定时打印，调高UVM打印级别等。

2023-05-10 标签：TCL VCS Verdi 3050 0

介绍SystemVerilog几种常用的调试功能

可视化调试主要分为Post-process和Interactive这两种模式。可视化调试工具是工程师在定位代码问题时的有力工具，也是现在验证工程师主流的...

2023-01-09 标签：EDA工具 VCS DUT 3006 0

如何对Verilog/SystemVerilog代码加密

os模块中的system()函数接受一个字符串参数，其中包含要执行的命令。在21-22行中，line为字符串变量，和前面双引号中的linux命令拼接在一...

2024-01-15 标签：Verilog 字符串 VCS 2637 0

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为防止静电积累所引起的人身电击、火灾和爆炸、电子器件失效和损坏，以及对生产的不良影响而采取的防范措施。其防范原则主要是抑制静电的产生，加速静电泄漏，进行静电中和等。
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