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Verilog HDL是一种硬件描述语言(HDL:Hardware Description Language),以文本形式来描述数字系统硬件的结构和行为的语言,用它可以表示逻辑电路图、逻辑表达式,还可以表示数字逻辑系统所完成的逻辑功能。
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2016-05-11 标签:Verilog HDL 825 0
2016-05-11 标签:Verilog HDL 772 0
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2015-09-14 标签:数字系统Verilog HDL 354 0
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