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Verilog HDL是一种硬件描述语言（HDL:Hardware Description Language），以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。

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verilog资讯

通过Verilog实现对一个频率的任意占空比的任意分频

在verilog程序设计中，我们往往要对一个频率进行任意分频，而且占空比也有一定的要求这样的话，对于程序有一定的要求，现在我在前人经验的基础上做一个简单...

2023-01-05 标签：fpga Verilog 2856 0

两个网络相关的开源项目详解

今天介绍两个（only two）网络相关的开源项目。 Alex的verilog-ethernet之前在介绍PCIe项目时有介绍过Alex的项目，当时重点...

2021-10-27 标签：fpga Verilog 开源 2846 0

Verilog如何实现一阶sigma_delta DAC

一阶 sigma-delta 调制器类似于 PWM，但如果需要对其进行滤波，则具有更好的频率响应，因为它具有更高的频率输出内容。创建一阶 sigma-...

2021-07-23 标签：Verilog 2786 0

Johnson约翰逊计数器Verilog实现

扭环形计数器，约翰逊计数器，每次状态变化时仅有一个触发器发生翻转，译码不存在竞争冒险，在n（n≥3）位计数器中，使用2n个状态，有2^n-2n个状态未使用；

2022-06-15 标签：fpga Verilog 触发器 2711 0

Verilog设计过程中状态机的设计方法

“本文主要分享了在Verilog设计过程中状态机的一些设计方法。关于状态机状态机本质是对具有逻辑顺序或时序顺序事件的一种描述方法，也就是说具有逻辑顺...

2021-06-25 标签：Verilog 状态机 2703 0

verilog的逻辑运算符

写在前面之前曾经整理过verilog的各类运算符的表达方式，但是在学习的过程中并未深入研究关于逻辑运算符的相关知识，导致在实际使用过程中错误频出，下面...

2023-09-21 标签：Verilog 数字电路运算符 2639 0

Verilog HDL语言的数据类型和运算符

reg是寄存器数据类型的关键字，是数据存储单元的抽象，通过赋值语句可以改变寄存器存储的值。reg型数据常用来表示always模块内的指定信号，在alwa...

2022-05-18 标签：寄存器 Verilog 2630 0

Emacs的verilog-mode介绍

Verilog－mode是由Michael McNamara mac＠verilog．com和Wilson Snyder wsnyder＠wsnyder...

2023-01-24 标签：Verilog 代码编辑器 2620 0

基于Verilog HDL设计的UART模块

　　1 UART原理　　串行通信是指外部设备和计算机间使用一根数据线(另外需要地线，可能还需要控制线)进行数据传输的方式。数据在一根数据线上一位一位...

2010-08-02 标签：HD Verilog 2607 0

UART的发送数据模块及Verilog代码

代码注释有些匆忙，如有错误注释还请批评，仅作参考 UART Uart比较简单，所以仅对tx作比较详细的注释，但里面一些内容还是值得新手学习的 1开始位（...

2021-05-27 标签：Verilog 代码 2571 0

XILINXISE传统FPGA设计流程

在基本的FPGA模块编写完成后，要使用仿真工具对设计的模块进行仿真，验证模块的基本功能是否符合设计。功能仿真也被称为前仿真。常用的仿真工具有

2020-10-21 标签：fpga 赛灵思 Verilog 2531 0

SystemVerilog语言介绍汇总

作者:limanjihe https://blog.csdn.net/limanjihe/article/details/83005713 Syste...

2021-10-11 标签：Verilog System 函数 2466 0

ST-BUS总线接口模块的Verilog HDL设计

ST-BUS总线接口模块的Verilog HDL设计 ST-BUS是广泛应用于E1通信设备内部的一种模块间通信总线。结合某专用通信系统E1接口转换板的...

2009-09-26 标签：HD Verilog 2451 0

使用Verilog HDL设计实现Cordic算法

任何适合产品实现的算法，都是将简易实现作为第一目标。CORDIC算法是建立在适应性滤波器、FFT、解调器等众多应用基础上计算超越函数的方法。其核心思想是...

2021-08-16 标签：Verilog HDL 2422 0

Altium在Altium Designer软件内新增Aldec FPGA仿真技术

Altium和Aldec签署的OEM协议中决定将Aldec的FPGA仿真功能添加到Altium Designer软件中去。该协议的签署使进行FPGA（现...

2012-09-20 标签：FPGA Altium Verilog 2419 0

基于Verilog硬件描述语言的AES密码算法实现

　　0 引言　　密码模块是安全保密系统的重要组成部分，其核心任务就是加/解密数据。目前，分组密码

2010-10-15 标签：Verilog 2414 0

RISC处理器在Verilog中实现并使用 Xilinx ISIM进行验证

RISC 处理器是基于其指令集和哈佛型数据通路结构设计的。然后，RISC 处理器在Verilog 中实现并使用 Xilinx ISIM 进行验证。 RI...

2021-08-10 标签：处理器 Verilog RISC 2371 0

FPGA图像的亮暗调节之变暗调节

1基本原理真彩色图像的颜色通道分为R，G，B。按照RGB888来讲，三个通道分别为8bit，范围为0-255。因为图像数据是无符号的所以再亮暗调节的...

2021-06-10 标签：仿真图像数据 Verilog 2341 0

简单介绍一下时序和组合逻辑的一些知识

由于数字电路是由用导线连接的逻辑门组成的，因此任何电路都可以表示为module和assign语句的某种组合。

2022-09-16 标签：仿真器 Verilog 数字电路 2296 0

Verilog HDL-同步技术你了解多少

同步技术在芯片设计中，数据同步和在不同时钟域之间进行数据传输会经常出现。为避免任何差错、系统故障和数据破坏，正确的同步和数据传输就显得格外重要。这些问...

2021-09-18 标签：usb fifo Verilog 2279 0

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