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　　Vivado设计套件，是FPGA厂商赛灵思公司2012年发布的集成设计环境。包括高度集成的设计环境和新一代从系统到IC级的工具，这些均建立在共享的可扩展数据模型和通用调试环境基础上。

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vivado技术

如何在Vivado中实现逻辑锁定和增量编译工程实例说明

本文针对Vivado中实现的逻辑锁定和增量编译进行的工程实例介绍，文中有对应工程的下载地址。友情提示：（1）增量编译只允许修改当前工程不超过5%的时候才...

2019-07-06 标签：FPGA 寄存器 Vivado 7210 0

Vivado 设计套件使用方法和注意事项

想到要写这一系列关于工具和方法学的小文章是在半年多前，那时候Vivado已经推出两年，陆陆续续也接触了不少客户和他们的设计。我所在的部门叫做“Tools...

2019-08-01 标签：赛灵思约束 Vivado 3112 0

Vivado使用教学设计技巧

其中，-include_generated_clocks 表示所有衍生钟自动跟其主时钟一组，从而与其它组的时钟之间为异步关系。不加这个选项则仅仅将时钟关...

2019-07-24 标签：Vivado 时钟约束 3285 0

用Tcl定制Vivado设计流程详解

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2019-07-24 标签：TCL 设计流程脚本 4724 0

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2019-08-01 标签：赛灵思 Vivado 5591 0

KPA EtherCAT主站在Zynq平台的移植与测试

实验平台包括三个组成部分:待测试的EtherCAT系统、实时数据获取单元和离线的实验数据分析单元,如下图所示。主站为构建的嵌入式实时EtherCAT 主...

2019-07-30 标签：以太网通信设备 Vivado 3.9万 0

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在某些情况下会出现日志不足的状况，并且需要与赛灵思共享 RTL 设计，才能对问题进行进一步调试。

2019-07-25 标签：Vivado 时序优化 1.4万 0

简要说明如何使用“work” 库

因此，即使 bottom2.vhd 已被编译为一个名为“work”的物理库，并且顶层由“work”库例化了底部，但该工具仍然会使用 bottom1.vh...

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技巧分享：如何在Vivado中正确使用接口

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关于Vivado 2019.1的Dashboard功能详解

关于Vivado Dashboard的功能可阅读这篇文章（Vivado 2018.3这个Gadget你用了吗）Vivado 2019.1的Dashboa...

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如何缩短Vivado的运行时间

在Vivado Implementation阶段，有时是有必要分析一下什么原因导致运行时间（runtime）过长，从而找到一些方法来缩短运行时间。

2019-05-29 标签：Vivado 时序驱动 1.4万 0

数字设计FPGA应用：FPGA的基本实践

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2019-12-05 标签：fpga xilinx vivado 3217 0

数字设计FPGA应用：硬件描述语言与VIVADO

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2019-12-05 标签：fpga verilog hdl vivado 2487 0

Vivado路径过长报错的两个解决方法

下图红圈的英文是这样描述的：temporary directory paths exceeds 146 characters。中文意思是说，临时文件路径...

2019-03-30 标签：windows vivado 7263 0

使用Vivado 2017调用Modelsim的详细步骤

本次使用的Vivado版本为Vivado_2017.3版本，从Xilinx官方文档可以了解到，该版本的Vivado只支持Modelsim10.6或者更高...

2019-03-30 标签：modelsim vivado 1.8万 1

Vivado综合操作中的重定时（Retiming）

有两种不同的重定时方法，向后重定时和向前重定时。向后重定时从门的输出中删除寄存器，并在同一逻辑门的输入出创建新的寄存器。向前重定时的作用正好相反，它从逻...

2019-03-14 标签：寄存器总线 Vivado 1.9万 0

基于Vivado下固化FLASH的压缩和提高加载速度

今天发布一个Vivado 下固化 FLASH的压缩和提高加载速度的技巧和方法。这个方法对于需要快速加载程序的场合特别有用比如PCIE 需要满足200MS...

2019-04-20 标签：fpga flash vivado 1.0万 0

Vivado 2018.3 report_qor_suggestions怎么用

如果选择Synth and Impl，会生成两个文件：RQSPreSynth.tcl和RQSImplCommon.tcl。Project模式下，RQSP...

2019-01-15 标签：寄存器 Vivado 5830 0

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以上图中的Type选取Timing为例，Reports一栏可以浏览到的报告如下图所示。这里，这些报告之所以可见，是因为事先在设置Implementati...

2019-01-08 标签：Vivado 7357 0

Vivado FPGA设计基础操作流程:Vivado的基本使用

选择器件或者板卡。Parts表示器件，当然如果是板卡就点击Boards。器件可以根据系列去选，也可以直接在Search栏搜索器件型号。器件的选择根据你的...

2018-12-21 标签：FPGA Vivado 2.6万 0

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