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　　Vivado设计套件，是FPGA厂商赛灵思公司2012年发布的集成设计环境。包括高度集成的设计环境和新一代从系统到IC级的工具，这些均建立在共享的可扩展数据模型和通用调试环境基础上。

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vivado技术

Vivado增量编译的基本概念、优点、使用方法以及注意事项

随着FPGA设计的复杂度不断提高，设计人员需要选择更为高效的设计流程来保证开发效率和减少开发成本。其中，Vivado增量编译是一种非常重要的设计流程。本...

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Xilinx FPGA远程调试方法(二)

上篇主要是分享了Vivado编译软件远程调试的方法。杰克使用Vivado软件进行远程连接，主要是用于固化程序以及FPGA(PL端)的异常排查。而本篇主要...

2023-05-25 标签：fpga Xilinx 远程调试 2643 0

FPGA设计中如何防止信号被优化

本文分别对quartus和vivado防止信号被优化的方法进行介绍。

2023-05-25 标签：fpga 信号引脚 3369 0

AMD Artix 7 FPGA OTA在线升级的实现

AMD FPGA支持的MultiBoot特性，可以使FPGA先尝试启动最新的配置（bit）文件，后续称为Update Bit。如果最新的配置文件出错，再...

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如何在Vivado硬件管理器内读取各项监控值？

在 Vivado 内，以 Versal 器件为目标创建一个示例，此示例将以 VCK190 开发板为目标创建工程。创建块设计，并将 CIPS IP 添...

2023-05-17 标签：电源监控寄存器 PMC 3556 0

Vivado HDL编写示例

Vivado 软件提供了HDL编写中常用的示例，旨在帮助初学者更好地理解和掌握HDL编程，这里分享一下verilog代码示例。

2023-05-16 标签：寄存器 HDL 锁存器 1007 0

Vivado：ROM和RAM的verilog代码实现

本文主要介绍ROM和RAM实现的verilog代码版本，可以借鉴参考下。

2023-05-16 标签：ROM RAM Verilog 1618 0

Vivado综合参数设置

如果你正在使用Vivado开发套件进行设计，你会发现综合设置中提供了许多综合选项。这些选项对综合结果有着潜在的影响，而且能够提升设计效率。为了更好地利用...

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Vivado布线和生成bit参数设置

本文主要介绍Vivado布线参数设置，基本设置方式和vivado综合参数设置基本一致，将详细说明如何设置布线参数以优化FPGA设计的性能，以及如何设置V...

2023-05-16 标签：fpga 参数布线 4528 0

Vivado关联第三方编辑器的方法

Vivado是一个非常强大的工具，但是在一些方面可能不能完全满足我们的需求，比如代码编辑器的功能。幸运的是，Vivado允许我们关联第三方编辑器来扩展其...

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跨时钟域电路设计：多位宽数据通过FIFO跨时钟域

FIFO是实现多位宽数据的异步跨时钟域操作的常用方法，相比于握手方式，FIFO一方面允许发送端在每个时钟周期都发送数据，另一方面还可以对数据进行缓存。需...

2023-05-11 标签：电路设计 fifo 信号 2963 0

使用Vivado调用questasim仿真报错的原因及其解决办法

有一天使用Vivado调用questasim(modelsim估计也一样)，仿真报错

2023-05-08 标签：Vivado 3002 0

如何通过Vivado Synthesis中的URAM矩阵自动流水线化来实现最佳时序性能

UltraRAM 原语（也称为 URAM）可在 Xilinx UltraScale + 架构中使用，而且可用来高效地实现大容量深存储器。由于大小和性能方...

2023-05-08 标签：存储器 Xilinx 流水线 1679 0

Vivado调用Questa Sim仿真中存在的一些问题

首先说明一下Modelsim与Questa Sim都可以与Vivado联调，也比较相似，但是Questa Sim比Modelsim功能更加广泛

2023-05-08 标签：仿真器 TCL Vivado 5082 0

FPGA设计中大位宽、高时钟频率时序问题调试经验总结

时钟周期约束：用户需要将设计中的所有时钟进行约束后，综合器才能进行合理的静态时序分析。一个设计中的时钟主要分为两类：主时钟和生成时钟。主时钟包括由全局时...

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简述Vivado中的Elaborate的作用

在Vivado的界面中，有个RTL ANALYSIS->Open Elaborated Design的选项，可能很多工程师都没有使用过。因为大家基...

2023-05-05 标签：RTL design Vivado 1245 0

linux vivado安装时卡在最后一步怎么办

在ubuntu上安装vivado2021.1时，一直卡在最后一步：generating installed device list 安装其他版本也...

2023-05-05 标签：Ubuntu Vivado 2991 0

在Vivado中实现ECO功能

关于 Tcl 在 Vivado中的应用文章从 Tcl 的基本语法和在 Vivado 中的应用展开，继上篇《用 Tcl 定制 Vivado 设计实现流程...

2023-05-05 标签：fpga IC设计 Xilinx 2598 0

用TCL定制Vivado设计实现流程

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2023-05-05 标签：fpga Xilinx TCL 1051 0

Vivado使用进阶：读懂用好Timing Report

《XDC 约束技巧》系列中讨论了XDC 约束的设置方法、约束思路和一些容易混淆的地方。我们提到过约束是为了设计服务，写入 Vivado中的 XDC 实...

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