可编程逻辑

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FPGA加法截位处理方法介绍

本模块实现输入与输出位宽相同数据加法，并对结果进行四舍五入截位，对标matlab round函数。...

2024-04-18 标签：FPGA matlab 360

FPGA通过AXI总线读写DDR3实现方式

AXI总线由一些核心组成，包括AXI主处理器接口（AXI4）、AXI处理器到协处理器接口（AXI4-Lite）、AXI主外设接口（AXI4）、AXI外设到主处理器接口（AXI4-Lite）等。...

2024-04-18 标签：FPGA 总线 AXI DDR3 FPGA 总线 185

基于FPGA的多通道高速信号采集与处理平台设计方案

以核心处理板为核心，由信号源产生的待处理模拟信号通过同轴线缆连接到核心处理板的信号接口，同时，连接同步时钟等其他相关信号到核心处理板。...

2024-04-17 标签：FPGA 信号完整性 FPGA 信号完整性信号采集处理电源完整性 108

易灵思RAM使用--Update4

易灵思RAM在使用时可以会遇到一些问题，这里把常用的问题总结下。 1、ram初始化文件路径是工程路径在对ram进行初始化时需要指定文件路径，这里要注意'/'的方向。（1）如果文件放在工程目...

2024-04-23 标签：RAM RAM 易灵思 483

为什么使用FPGA？FPGA为什么比GPU的延迟低这么多？

众所周知，通用处理器（CPU）的摩尔定律已入暮年，而机器学习和 Web 服务的规模却在指数级增长。...

2024-04-16 标签：处理器 FPGA 寄存器浮点运算 FPGA GPU芯片处理器寄存器浮点运算 854

利用ISE与Matlab创建并仿真FPGA设计中的ROM IP核

一般都是先创建MIF文件，将图像中的像素信息用一个ROM储存起来，然后调用ROM里面的地址进行处理，相当于制作了一个ROM查找表。...

2024-04-16 标签：FPGA matlab ROM 107

FPGA的优势及潜在局限性介绍

了解FPGA器件何时适合实现所需的系统功能是理解FPGA技术的关键要素。设计团队明白FPGA技术并不适用于每一个设计或应用程序。...

2024-04-16 标签：FPGA FPGA 分立器件 123

3568F-FPGA案例开发手册

3568F-FPGA案例开发手册...

2024-04-16 标签：FPGA FPGA 创龙科技 780

基于FPGA的分布式视频处理平台设计方案

目前人们对于高清视频的需求日益普遍，极致的视觉体验带来的是技术上的革新，...

2024-04-15 标签：FPGA DDR3 PCB设计 CORTEX-A9 DDR3 FPGA PCB设计 PCIe接口 881

CAM在FPGA上的最优化实现方案

我们都知道RAM是根据地址查找对应的数据，而对于CAM，则恰好相反，是已知数据查找其对应的地址。像在网络报文处理里，根据报文的五元组的一些信息去查询其所属的规则地址，随后通过该地...

2024-04-15 标签：FPGA 寄存器 RAM FPGA RAM TCAM 寄存器 155

FPGA在驾驶辅助系统中的关键作用

发动机控制几乎从未被认为是获得更好燃油经济性的一种方式。但在燃油价格不断上涨的今天，电子技术可以非常有效地提高燃油经济性。...

2024-04-15 标签：FPGA 发动机 ecu ecu FPGA 发动机发动机控制通信系统 146

易灵思Jtag_bridge_loader生成-v2

Efinity版本：2023.1及以前版本。易灵思器通过jtag bridge烧写flash时需要自己生成一个jtage birdge文件。jtage bridge 工程的目的是为了打通JTAG与flash的连接。（1）打开IPM (2)选择Memory Controllers --> J...

2024-04-15 标签：FPGA FlaSh JTAG 易灵思 602

AMD自适应计算加速平台之GTYP收发器误码率测试IBERT实验(6)

实验VIvado工程为“ibert_test”,目录中还有一个“ibert_ex”，是生成的测试工程。...

2024-04-12 标签：收发器 amd JTAG 光模块光纤接口 amd JTAG SFP 光模块光纤接口收发器 1117

XC7K410T-FFG900外设之DDR3硬件设计方案分享

在数据速率带宽约束方面，DDR3运行速度受限于其与K7-410T FPGA互联的I/O Bank 管脚以及FPGA器件的速度等级。...

2024-04-12 标签：FPGA DDR3 存储器 Xilinx 信号完整性 DDR3 FPGA FPGA器件 Xilinx 信号完整性存储器时钟芯片 993

gtkwave界面每次都更新太麻烦？来个小技巧-v1

迄今为止，大家都在吐槽gtkwave debug每次弹窗都会覆盖上一次弹窗设置好的排序和参数。下面我们分享一个可以暂时规避该问题的方法，聊以慰藉久被摧残的心~~。（1）添加debug ,无论手动或者自...

2024-04-15 标签：FPGA FPGA Wizard 656

FPGA 原型设计开发复杂性策略

FPGA 被封装在更大的封装中，从而提供了更多的 I/O。"然而，I/O 的增加并不像逻辑资源那样引人注目。...

2024-04-11 标签：FPGA asic soc HDL 机器学习 103

基于紫光FPGA的CAN控制器系统架构

通过用户接口管理配置，控制CAN寄存器的寻址。向位时序模块、can发送模块和can接收模块提供配置信息和操作指令，并接收来自can接收模块的状态信息。...

2024-04-10 标签：FPGA CAN 串行通信 CAN CAN控制器 FPGA 串行通信紫光 124

浅谈FPGA、ASIC和RFSOC

数据转换功能的集成为5G基站中的远程无线单元（RRU）提供了巨大的节能效果。对于每个JESD204通道，节省的成本大约为1W，或者对于来自天线阵列的每个数据流来说，节省的成本是不同的。...

2024-04-10 标签：FPGA 收发器 asic 5G 5G asic FPGA RFSoC 收发器 191

英特尔和Altera宣布推出全新边缘优化处理器、FPGA可编程解决方案

今天，英特尔及其子公司Altera在嵌入式展（Embedded World）上，宣布推出全新边缘优化处理器、FPGA以及市场就绪的可编程解决方案，致力于将强大的AI功能扩展到边缘计算。...

2024-04-10 标签：处理器 FPGA 英特尔嵌入式 Altera 405

FPGA设计中为何应慎用锁存器

锁存器、触发器和寄存器它们的英文分别为：Latch、Flip-Flop、Register。我们对这三个单词的翻译真的是非常直观，从名字就能大概猜出它们的含义。...

2024-04-10 标签：FPGA 寄存器锁存器触发器 FPGA 寄存器时序逻辑电路触发器锁存器 81

FPGA助力简化电源设计

科通技术了解到AnDAPT电源解决方案的目标市场是电源轨数量较多的市场，因此需要电源管理功能，并通过AnDAPT产品线帮助AMD产品线的客户简化电源设计。...

2024-04-10 标签：FPGA 芯片 Agi FPGA 芯片 95

基于FPGA加速的bird-oid object算法实现

Bird-oid object 简称Boids模型，是美国的一个图形计算机科学家Craig Reynolds在 1986 年开发出来的。...

2024-04-09 标签：FPGA SoC芯片 ARM处理器 FPGA SoC芯片 354

基于FPGA加速的热扩散模拟器

这个项目的目标是创建一个交互式的热扩散模拟器，它使用离散域上的热方程，允许用户在VGA屏幕上选择热源和热汇，并在VGA屏幕上实时模拟出随之产生的反应。...

2024-04-09 标签：FPGA ARM处理器模拟器 ARM处理器 FPGA VGA 模拟器 332

基于FPGA的TLC5620数模转换（DA）设计

本设计采用串行数/模转换芯片TLC5620，TLC5620是一个拥有四路输出的数/模转换器，时钟频率最大可达到1MHz。...

2024-04-08 标签：FPGA 运算放大器 FPGA 基准电源数模转换数模转换器运算放大器 273

FPGA为什么比GPU的延迟低这么多？

FPGA 正是一种硬件可重构的体系结构。它的英文全称是Field Programmable Gate Array，中文名是现场可编程门阵列。 FPGA常年来被用作专用芯片（ASIC）的小批量替代品，然而近年来在微软、百度等公...

2024-04-08 标签：cpu gpu 图像处理交换机机器学习 407

基于FPGA的网络加速设计实现

首先是FPGA硬件的变化太多，各个模块可配参数的变化（比如卷积模块并行数的变化），另外一个是网络模型多种多样以及开源的网络模型平台也很多（tensorflow，pytorch等）。网络压缩也有很多种...

2024-04-08 标签：FPGA 神经网络 FPGA 神经网络算力 118

基于FPGA进行DNN设计的经验总结

DNN中应用最广泛的是CNN和RNN，CNN是一种卷积网络，在图片识别分类中用的较多，RNN可以处理时间序列的信息，比如视频识别和语音识别。...

2024-04-07 标签：FPGA cpu 神经网络机器学习 cpu dnn FPGA 机器学习神经网络 108

深入探索Vivado非工程模式FPGA设计流程

在设计过程的每个阶段，设计者均可以打开Vivado集成开发环境，对存储器中保存的当前设计进行分析和操作。...

2024-04-03 标签：FPGA 数据库 Vivado 137

详解Vivado非工程模式的精细设计过程

将设置设计的输出路径，设置设计输出路径的步骤如下所示。第一步：如图4.3所示，在“Vivado%”提示符后输入命令“set outputDir ./gate_Created_Data/top_output”。...

2024-04-03 标签：Xilinx WINDOWS 操作系统 Vivado 126

易灵思FPGA flash操作原理

易灵思FPGA flash操作原理分享...

2024-04-09 标签：FPGA FlaSh 易灵思 512

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