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InterfaceDesinger 使用案例-v1 -DDIO用法

XL FPGA技术交流 来源: XL FPGA技术交流 作者: XL FPGA技术交流 2024-05-20 16:30 次阅读

DDIO用法

对于输入输出IO很多时候会用到DDIO的用法。对于DDIO,就是时钟的双沿采集或者发送数据,所以必须要用到寄存器。它的设置也比较简单,在intefaceDesigner中添加GPIO,并把register Option设置为register,另外要设置Double Data IO Option模式,分别为normal和resync。

f0cc70a8-0b41-11ef-b759-92fbcf53809c.png

下图是易灵思的GPIO的结构。

f0e998ae-0b41-11ef-b759-92fbcf53809c.png

对应上图我们以ODDIO为例,分别标出了reg1,reg2和reg3三个寄存 器。当OUT0为上升沿的触发信号,即HI,OUT1为下降沿的触发信号,即LO。当DDIO模式设置为Normal mode时,OUT1经过reg3输出;当设置为Resync mode时OUT1经过了reg2和reg3,reg2用于对数据打一拍来对齐数据,下面是数据的输出波形。

f0f8ee58-0b41-11ef-b759-92fbcf53809c.png

我们只需要在top模块中添加相应信号即可以用于控制:

module DDIO_Test(...  otuputoddio_HI,  output oddio_LO,
...
);

下图为数据输入时的波形,分别对应 Normal和Resync mode。

f111250e-0b41-11ef-b759-92fbcf53809c.png


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