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总线接口读/写仿真如图5所示，(a)为总线接口写仿真，(b)为总线接口读仿真。
图5 总线接口读/写仿真图
结语
本文实现单片机与FPGA/CPLD的总线接口逻辑设计，是设计的高速采样设备的一部分。经仿真验证以及实际应用，证明该接口原理应用完全正确、可行。在笔者设计的多个系统中，也已经成功地进行了应用。该电路由于接口简单容易控制，因此，在涉及FPGA与单片机系统的接口电路中，可以灵活地应用。
- 基于单片机与FPGA的总线接口逻辑设计
- FPGA(591969)
- 单片机(619333)
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