可编程逻辑

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FPGA工程的时序约束实践案例

详细的原时钟时序、数据路径时序、目标时钟时序的各延迟数据如下图所示。值得注意的是数据路径信息，其中包括Tco延迟和布线延迟，各级累加之后得到总的延迟时间。...

2024-04-29 标签：FPGA 寄存器 adc 时序约束 654

Ti60F100 内外flash操作方案

有客户认为Ti60F100内部flash容量比较小，只有16Mb，需要外挂flash.这里我们提供了内部flash和外部flash分别操作的方案。该程序是通过SOC操作4线的外部flash和内部flash.程序先经过外部flash的擦除，写...

2024-05-20 标签：FlaSh 1413

基于FPGA的FIR数字滤波器设计方案

FPGA元器件在高速并行处理和数据传输中有独特优势，FPGA正在前端信号处理中越来越多地代替ASIC和DSP。我们需要的就是这种设计周期短，功能密度高，重组时间短的元器件。...

2024-04-28 标签：dsp FPGA asic 数字滤波器信号处理 3109

Xilinx FPGA的约束设置基础

LOC约束是FPGA设计中最基本的布局约束和综合约束，能够定义基本设计单元在FPGA芯片中的位置，可实现绝对定位、范围定位以及区域定位。...

2024-04-26 标签：FPGA Xilinx 字符串 1079

中国FPGA市场竞争格局分析

AMD（Xilinx）FPGA相关产品矩阵主要包括：四大 FPGA产品系列（VIRTEX、KINTEX、ARTIX、SPARTAN），以及集成度更高的两大自适应 SoC（Adaptive SoC）系列（ZYNQ、VERSAL）。...

2024-04-26 标签：FPGA amd eda 通信网络 RISC-V 1237

基于Verilog HDL的FPGA图像滤波处理仿真实现

注意这里的A是double类型的，直接进行imshow会全白，要转化到0-1：A=A./255，或者把double类型转化为整形。...

2024-04-26 标签：FPGA Verilog FPGA Verilog 图像滤波 514

基于FPGA的光纤通信加密系统

FPGA 设计加密算法具有安全性高，加密速度快，开发周期短，开发成本较低，可重配，可靠性高以及移植性好等优点。系统链路部分采用 Aurora 协议，该协议是一款轻量级的光纤链路协议，具有...

2024-04-26 标签：FPGA 光纤通信光通信光模块 1091

Zynq-7000为何不是FPGA？

Zynq-7000可扩展处理平台是采用赛灵思新一代FPGA（Artix-7与Kintex-7FPGA）所采用的同一28nm可编程技术的最新产品系列。...

2024-04-26 标签：处理器 FPGA 可编程逻辑嵌入式处理器 Zynq 1089

基于FPGA的内部LVDS接收器设计

LVDS是一种低压低功耗的高速串行差分数据传输标准，在高速数据互联和数据通信领域得到广泛的应用，主流的FPGA器件都集成了高速的LVDS收发器。...

2024-04-26 标签：FPGA 模拟电路 adc lvds 模数转换器 1585

时序约束实操

添加约束的目的是为了告诉FPGA你的设计指标及运行情况。在上面的生成约束之后，在Result àxx.sdc中提供约束参考（请注意该文件不能直接添加到工程中，需要热复制到别的指定目录或者新建自...

2024-04-28 标签：FPGA pll 时钟时序约束 2172

基于自研芯片+顶级AMD FPGA，西门子EDA发布“快而全”的Veloce CS

电子发烧友网报道（文/吴子鹏）在大型芯片设计过程中，验证被认为是整体流程中最复杂、最耗时的环节之一。有数据显示，目前功能验证约占整个芯片开发过程投入的60%-70%，是芯片项目能否...

2024-04-26 标签：FPGA amd 西门子 eda 3664

FPGA的时钟电路结构原理

FPGA 中包含一些全局时钟资源。以AMD公司近年的主流FPGA为例，这些时钟资源由CMT（时钟管理器）产生，包括DCM、PLL和MMCM等。...

2024-04-25 标签：FPGA 锁相环 pll 时钟信号 FPGA pll 时钟信号时钟管理器锁相环 1716

AMD FPGA中MicroBlaze的固化流程详解

AMD FPGA在配置了适当的启动模式后，上电即会按该模式去加载配置文件。以7系列FPGA为例，假设设置模式引脚M[2:0]=3’b001，上电后FPGA会以Master SPI方式尝试从FLASH加载配置文件，其与工程是否含有...

2024-04-25 标签：FPGA amd uart 嵌入式处理器 GPIO 455

基于FPGA设计的BRAM内部结构

再看末级触发器对BRAM时序性能的影响，下图依次展示了7系列FPGA、UltraScale+和Versal芯片在未使用和使用末级触发器两种情形下时钟到输出的延迟。...

2024-04-25 标签：FPGA 锁存器触发器 BRAM 375

基于FPGA技术的USB2.0接口设计实践

本次设计我们选择一款开发设备，一块廉价的开发板，其中的USB芯片是Cypress的FX2LP系列中的CY7C68013A代，详细的介绍大家可以去Cypress的官网查询。下面简述一下设计思路。...

2024-04-25 标签：FPGA 单片机 usb 上位机 type-c 1292

Xilinx FPGA BGA推荐设计规则和策略（二）

工程师必须在设计阶段早期评估功率需求，以确保有足够的层和面积为需要功率的BGA焊盘提供足够的功率。...

2024-05-01 标签：FPGA BGA VRM 电压调节器负载电压 810

FPGA技术的五大优势

各行各业纷纷采用FPGA芯片是源于FPGA融合了ASIC和基于处理器的系统的最大优势。 FPGA能够提供硬件定时的速度和稳定性，且无需类似自定制ASIC设计的巨额前期费用的大规模投入。...

2024-04-23 标签：FPGA 集成电路 asic 信号处理器 1055

基于FPGA VHDL的ASK调制与解调

ASK即“幅移键控”又称为“振幅键控”，也有称为“开关键控”（通断键控）的，所以又记作OOK信号。ASK是一种相对简单的调制方式。...

2024-04-22 标签：FPGA 模拟信号 vhdl ASK FPGA vhdl 模拟信号调制信号 528

基于FPGA BRAM的多端口地址查找表与FPGA BRAM的资源分析

在多端口交换机的设计中，交换机的每个端口都会各自维护一张查找表，数据帧进入到交换机后，需要进行查表和转发。...

2024-05-01 标签：FPGA 存储器交换机 BRAM Vivado 1408

基于FPGA的数字电压表（AD）设计

TLC549是一个8位的串行模数转换器，A/D转换时间最大为17us，最大转换速率为4MHz。下图为TLC549的访问时序，从图中可以看出，TLC549的使用只需对外接输入输出时钟（I/O CLK）和芯片选择（/CS）、输...

2024-04-22 标签：FPGA 转换器电压表模数转换器模拟信号 1130

Xilinx 7系列FPGA功能特性介绍

Xilinx7系列FPGA由四个FPGA系列组成，可满足一系列系统需求，从低成本、小尺寸、成本敏感的大容量应用到最苛刻的高性能应用的超高端连接带宽、逻辑容量和信号处理能力。...

2024-04-22 标签：微控制器 FPGA 收发器 Xilinx 信号处理 4920

基于FPGA技术的手势识别控制型多功能机械臂系统

首先通过图像采集设备来获取手势图像，通过手势建模将获取的手势图像用数学模型描述出来，最后根据得到的手势识别所需要的模型参量判别出具体的手势形态。...

2024-04-27 标签：FPGA 手势识别机器视觉机械臂 1148

基于FPGA技术的智能驾驶辅助系统设计方案

图像的采集使用的是 NUOXI ZL-008 型号USB 摄像头，该摄像头支持分辨率640*480，帧率 30 帧/秒，增强像素数1200 万，可以满足本文研究中对图像的清晰度和实时性的要求。...

2024-04-27 标签：FPGA 示波器 soc FPGA soc 汇编器示波器 478

Xilinx FPGA BGA设计：NSMD和SMD焊盘的区别

Xilinx建议使用非阻焊定义的（NSMD）铜材BGA焊盘，以实现最佳板设计。NSMD焊盘是不被任何焊料掩模覆盖的焊盘，而阻焊定义的（SMD）焊盘中有少量阻焊层盖住焊盘平台。...

2024-04-19 标签：FPGA SMD Xilinx BGA 焊盘 2455

基于FPGA的内存128M flash芯片控制器设计方案

这款flash芯片的的存储是一个扇区4KB，一个扇区可以存256个字，一个字是8位，一个块是64KB，一共有256个块组成一个存储flash内存。...

2024-04-19 标签：FPGA FlaSh 内存状态寄存器 FlaSh FPGA 内存状态寄存器芯片控制器 1103

基于FPGA的网络摄像头图像封装处理

上位机才能够在接收数据后正确显示图像。所以每帧图像的开始需要多传输8字节数据，一般规定每次传输一行数据，由于OV7725一行有640个像素，每个像素16位，而以太网每个时钟传输8位数据，...

2024-04-19 标签：FPGA 以太网摄像头上位机 FPGA 上位机上位机以太网摄像头网络摄像头 540

FPGA加法截位处理方法介绍

本模块实现输入与输出位宽相同数据加法，并对结果进行四舍五入截位，对标matlab round函数。...

2024-04-18 标签：FPGA matlab 716

FPGA通过AXI总线读写DDR3实现方式

AXI总线由一些核心组成，包括AXI主处理器接口（AXI4）、AXI处理器到协处理器接口（AXI4-Lite）、AXI主外设接口（AXI4）、AXI外设到主处理器接口（AXI4-Lite）等。...

2024-04-18 标签：FPGA DDR3 总线 AXI DDR3 FPGA 总线 1207

基于FPGA的多通道高速信号采集与处理平台设计方案

以核心处理板为核心，由信号源产生的待处理模拟信号通过同轴线缆连接到核心处理板的信号接口，同时，连接同步时钟等其他相关信号到核心处理板。...

2024-04-17 标签：FPGA 信号完整性电源完整性 FPGA 信号完整性信号采集处理电源完整性 1003

易灵思RAM使用--Update4

易灵思RAM在使用时可以会遇到一些问题，这里把常用的问题总结下。 1、ram初始化文件路径是工程路径在对ram进行初始化时需要指定文件路径，这里要注意'/'的方向。（1）如果文件放在工程目...

2024-04-23 标签：RAM 易灵思 1016

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