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• fpga数字钟介绍_fpga数字钟设计

  数字钟实际上是一个对标准频率（1HZ）进行计数的计数电路。由于计数的起始时间不可能与标准时间（如北京时间）一致，故需要在电路上加一个校时电路，同时标准的1HZ时间信号必须做到准确稳定，通常使用石英晶体振荡器电路构成数字钟。...

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• fpga介绍_fpga芯片系统结构图

  。FPGA芯片主要由7部分完成，分别为：可编程输入输出单元、基本可编程逻辑单元、完整的时钟管理、嵌入块式RAM、丰富的布线资源、内嵌的底层功能单元和内嵌专用硬件模块。...

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• 光学以太网互操作性介绍

  Steve Leibson ， Xilinx 战略市场营销和商业规划总监 我刚刚参加完在阿纳海姆举行的 OFC/NFOEC 会议，期间每天的所有议题都是高速光纤通信。在展会上，我在三个不同的展台观摩了三场不同的 100G CFP2 光模块演示： Oclaro 展台演示的是 Oclaro LR4 CF...

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• LCD电路及高速ADC+FPGA+ DSP的设计方案介绍

  随着人们生活水平的提高，公路上的私家车辆也增多了，但随之带来的问题就是交通事故发生率居高不下，严重危害着人们的生命安全。文中就如何预防交通事故发生，研究设计一种响应迅速、高可靠性并且经济实用的汽车防擅报警设备。该设备在设计过程中的关键任务是利用置于汽车车头左右两端的双路通道高速采集激光雷达回波信号并...

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• 设计FPGA系统时通常需要考虑的问题分析

  许多工程师认为，只要定义了 FPGA 的功能，工作就算完成了。但实际上将 FPGA 插入 PCB 时也会面临一系列挑战。 对于许多工程师和项目经理来说，在 FPGA 中实现功能并实现时序收敛是主要目标，但实际上在印刷电路板上设计 FPGA 的硬件级工作也会出现很多有趣的挑战，只有解决了这些挑战才能实...

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• 运行中配置转换长度的并行FFT（PFFT）设计介绍

  超高速快速傅里叶变换（FFT）内核是任何实时频谱监测系统的必要组成部分。随着各频段无线设备数量的迅速增长，系统必须相应加强对带宽的监测。因此，这些系统需要以更快的速度将时域转换为频域，这就要求进行更加快速的FFT运算。实际上，大多数现代监测系统往往需要使用并行FFT，实现数倍于尖端FPGA（例如赛灵...

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• 基于System Verilog的可重用验证平台设计及验证结果分析

  采用System Verilog语言设计了一种具有层次化结构的可重用验证平台，该平台能够产生各种随机、定向、错误测试向量，并提供功能覆盖率计算。将验证平台在Synopsys公司的VCS仿真工具上运行，并应用到包交换芯片的仿真验证中。仿真结果显示，新设计的验证平台能通过修改随机信号约束条件和产生随机信...

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• 基于 FPGA 客户端的分布式计算网络设计

  高校和私企正在应用分布式平台，而不是安装速度更快、耗电更大的超级计算机来解决日益复杂的科学算法，针对SETI@home 这样的项目，他们则使用数以千计的个人计算机来计算它们的数据。[1，2] 当前的分布式计算网络一般用CPU 或 GPU 来计算项目数据。 FPGA 也正被像 COPACOBANA这样...

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• 在Zynq SoC上实现裸机（无操作系统）软件应用方案

  Zynq™-7000 All Programmable SoC在单个器件上实现了ARM处理功能与FPGA逻辑独特的组合，因此需要双重的配置过程，同时需要考虑处理器系统和可编程逻辑。工程师会发现，其配置顺序与传统的赛灵思FPGA稍有差别。尽管如此，方法仍是相似的，生成引导镜像和完成配置存储器编程的难度...

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• 利用MMCM实现多芯片相位对齐的串行收发器纠偏方法

  在一些特定的应用场景下，需要支持单板内多芯片串行收发器纠偏。要求各接收/发送机输入/出的数据相位差很小，比如250pS。为了达到该技术指标要求，必须使用多通道相位对齐技术、输入输出FIFO旁路技术。通常的相位对齐技术由于引入了Delay_Aligner，会带来2～4nS的相位不确定，不能满足系统指标...

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• 赛灵思业界20nm技术首次投片标志着UltraScale架构时代来临

  在28nm技术突破的基础上，赛灵思又宣布推出基于20nm节点的两款业界首创产品。赛灵思是首家推出20nm商用芯片产品的公司。此外，该新型器件也是赛灵思将向市场推出的首款采用UltraScale技术（可编程产业的首款ASIC级架构）的产品。UltraScale架构充分发挥Vivado设计套件中尖端ED...

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• Xilinx Vivado HLS中Floating-Point（浮点）设计介绍

  尽管通常Fixed-Point（定点）比Floating-Point（浮点）算法的FPGA实现要更快，且面积更高效，但往往有时也需要Floating-Point来实现。这是因为Fixed-Point有限的数据动态范围，需要深入的分析来决定整个设计中间数据位宽变化的pattern，为了达到优化的QoR...

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• 新手的FPGA学习必备的四个基础知识详解

  FPGA 已成为现今的技术热点之一，无论学生还是工程师都希望跨进FPGA的大门。网络上各种开发板、培训班更是多如牛毛，仿佛在告诉你不懂FPGA你就OUT啦。那么我们要玩转FPGA必须具备哪些基础知识呢?下面我们慢慢道来。 (一) 要了解什么是FPGA 既然要玩转FPGA，那我们首先最重要的当然是要了...

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• FPGA开发流程详细解析

  1. FPGA 开发流程： 电路设计与设计输入 ；仿真验证：利用Xilinx集成的仿真工具足矣 ；逻辑综合：利用XST(Xilinx Synthesis Tool)工具 ；布局布线：利用Xilinx的Implementation Tool工具 ；FPGA配置下载：利用iMPACT工具 2. 时序标注...

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• 基于Zynq SoC架构在器件的可编程逻辑内构建外设来加快处理速度

  Zynq SoC架构的主要优势之一就是能够通过在器件的可编程逻辑内构建外设来加快处理速度。 这是Adam Taylor 计划编写的Zynq-7000 All Programmable SoC实际操作教程系列的第三部分。前两部分教程分别刊登在《赛灵思中国通讯》第47期和48期。Adam 经常为《赛灵思...

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• 基于FPGA硬件平台的可重构系统调度算法详解

  可重构系统是指以软件改变硬件结构以实现具体应用的计算平台，一般由非柔性但可编程的处理器和柔性的以程序控制重构的数字逻辑器件构成。目前国内外的可重构系统研究中，采用的可重构硬件主要是现场可编程门阵列（Field Programming Gate Array， FPGA）。可重构系统非常适合于那些对功...

  2006次阅读 · 0评论 FPGA低功耗
  

• 关于FPGA时序以及时序收敛的基本概念详解

  FPGA器件的需求取决于系统和上下游（upstream and downstrem）设备。我们的设计需要和其他的devices进行数据的交互，其他的devices可能是FPGA外部的芯片，可能是FPGA内部的硬核。...

  9586次阅读 · 0评论 FPGA时序
  

• 赛灵思FPGA卷积神经网络，云中的机器学习

  人工智能正在经历一场变革，这要得益于机器学习的快速进步。在机器学习领域，人们正对一类名为“深度学习”算法产生浓厚的兴趣，因为这类算法具有出色的大数据集性能。在深度学习中，机器可以在监督或不受监督的方式下从大量数据中学习一项任务。大规模监督式学习已经在图像识别和语音识别等任务中取得巨大成功。...

  2789次阅读 · 0评论 FPGA赛灵思机器学习
  

• 关于CPU和FPGA的概念以及两者之间的联系详解

  看到Intel最近发布了QPI直连FPGA的架构，冬瓜哥回想起几个月前写的一篇文章，现在重新分享给大家。从中你可以了解为何需要FPGA，FPGA是怎么被连接到系统里的，怎么被使用的。闲话少说，今天我们说一说IBM搞的CAPI，CAPI是OpenPower体系里的一个技术，其目的是让FPGA更好更方...

  9814次阅读 · 0评论 FPGACPU

• 关于XADC模块的介绍和基本使用方法

  Zynq器件XADC模块包括2个12比特1 MIPS的模数转换器和相关的片上传感器，模数转换器能为系统应用提供通用目的的高精度的模拟接口，下图是XADC模块的框图。...

  21091次阅读 · 0评论 Xilinx数字电源模拟电源XADC
  
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