FPGA/ASIC技术
电子发烧友本栏目为FPGA/ASIC技术专栏，内容有fpga培圳资料、FPGA开发板、FPGA CPLD知识以及FPGA/ASIC技术的其它应用等；是您学习FPGA/ASIC技术的好栏目。
基于蜂鸟E203 RISC-V处理器内核的SoC设计
SM4算法是一种分组密码算法。其分组长度为128bit，密钥长度也为128bit。加密算法与密钥扩展算法均采用32轮非线性迭代结构，以字（32位）为单位进行加密运算，每一次迭代运算均为一轮变换函...
2022-08-01 2290
基于IDEA导出个人IP库设计的jar包
使用SpinalHDL进行电路描述是基于Scala来实现的,在进行设计输出的时候，那么，我们可以同样基于jar包的形式导出个人IP库设计。本篇就基于IDEA导出个人IP库设计的jar包。...
2022-07-28 466
线程终止的4种方式
PTHREAD_CANCEL_DEFERRED，延迟方式，线程只会在特定的取消点（cancellation points，调用某个函数前）被杀死。...
2022-07-27 893
RAM——单口、双口、简单双口、真双口的区别
在 WE = 0 时，两个口均为读出口，A 口的地址线 ADDR[3:0] 的地址为 0，在 SPO[7:0] 上读出数据 17，B 口的地址线 DPRA[3:0] 为 0，在 DPO[7:0] 上读出数据 17；...
2022-07-26 9803
ZYNQ7020的程序固化
阶段0，主要是运行芯片内部固化的BootROM程序，这个BootROM主要是识别启动模式（spi/sd/nand/nor/）是哪一种？...
2022-07-22 5136
FPGA帮助改进机器学习的模型训练过程
FPGA传统上被用作设计新数字芯片的早期验证原型已经很久了，但随着机器学习技术的出现，FPGA体现出了有别于传统应用更多的特质。...
2022-07-22 878
机器学习技术和FPGA的联系
最早的ML应用实现是软件导向的，并对CPU和GPU产生了巨大影响。但CPU和GPU面临的挑战在于其巨大的功耗——即使对于数据中心来说也是这样。“人们试着用软件实现创新，但却无法控制功耗...
2022-07-22 1096
锁相环的基本概念
鉴相器将输入周期信号的相位与压控振荡器输出信号的相位进行比较，得到相位差θc，PD将θc转换为误差电压信号ud(t)输出。误差电压通过环路滤波器进行滤波，滤除交流成分，滤波的过程即为...
2022-07-22 2062
FPGA工程师是如何实现复杂系统设计的
为了在越来越复杂的系统设计中，FPGA工程师之间保持高效沟通和工作推进，这就需要找到一个适合的设计方法论。目标是通过在设计团队之间建立一个通用的方法来提高FPGA设计团队的生产力，...
2022-07-22 684
Laplacian算子的硬件实现及结果
使用Laplacian算子滤波是将模板与图像做卷积运算，然后将得到的结果取绝对值后，再进行防治溢出(灰度值大于255)处理。所以在用硬件实现Laplacian算子时可分成三个步骤：构造模板；使用模板对...
2022-07-21 1019
英特尔FPGA中国创新中心的链接产业与人才 助FPGA人才走向实战
当前，5G、人工智能、自动驾驶等技术快速发展，应用场景也愈加广泛，这背后，有着灵活高效、高性能、低功耗等优势的可编程芯片FPGA功不可没。随着应用场景的扩大，FPGA的市场规模也迎来...
2022-07-20 861
FPGA三段式描述状态机的好处
先谈谈第二点关于思维习惯。我发现有些人会有这样一种习惯，先用一段式状态机实现功能，仿真ok后，再将其转成三段式，他们对这种开发方式的解释是一段式更直观，可以更便捷的构建功能...
2022-07-14 1399
FPGA上电（Master）
fpga 会从 0 开始读，地址不断自增，直到读取到有效的同步字 sync word(0xAA995566),才认为接下来的内容是一个有效的 bin 文件内容的开始。读到有效 sync word 后不会再继续读搜寻其他的 bin 文件。如...
2022-07-13 908
ZYNQ的XADC的相关内容
XADC具有两个12位的ADC，具有独立的跟踪和保持放大器，模拟多路复用器（最多17个外部模拟输入通道）以及片上散热和片上电压传感器。可以将两个ADC配置为同时采样两个外部输入模拟通道。采...
2022-07-11 1875
Verilog进行组合逻辑设计时的一些注意事项
always 模块的敏感表为电平敏感信号的电路可几乎可以完成对所有组合逻辑电路的建模。always模块的敏感列表为所有判断条件信号和输入信号，但一定要注意敏感列表的完整性（注意通配符*的使...
2022-07-11 2386
为什么要使用DC-SCM？
DC-SCM架构定义了与CPU板互操作的输入/输出端口。DC-SCM服务器在HPM（主机处理器模块）板上只有基本的中央计算元件（CPU）、高速存储器和IO连接器，其他所有组件均在模块化DC-SCM（安全、控制、...
2022-07-11 2198
分析FPGA开发工具套件如何与其先进的硬件进行结合呢
对于现今的FPGA芯片供应商，在提供高性能和高集成度独立FPGA芯片和半导体知识产权（IP）产品的同时，还需要提供性能卓越且便捷易用的开发工具。...
2022-07-10 550
FIFO队列原理简述
FIFO是队列机制中最简单的，每个接口上只有一个FIFO队列，表面上看FIFO队列并没有提供什么QoS保证，甚至很多人认为FIFO严格意义上不算做一种队列技术，实则不然，FIFO是其它队列的基础...
2022-07-10 1621
如何最大程度地降低地弹噪声对单板信号完整性影响
通过逻辑内部定位发现丢包地点为下行SSRAM读写处，即下行业务包写入SSRAM，再读出后包内容出错导致报文丢弃。FPGA外挂SSRAM结构框图见图1，进入FPGA内部的上行业务和下行业务都需要通过各自的...
2022-07-07 659
Verilog testbench总结
对于testbench而言，端口应当和被测试的module一一对应。端口分为input,output和inout类型产生激励信号的时候，input对应的端口应当申明为reg, output对应的端口申明为wire，inout端口比较特殊，下面专门...
2022-07-07 4618
从仿真器的角度对Verilog语言的语法规则进行解读
综合工具读入源文件，通过综合算法将设计转化为网表，比如DC。能够综合的特性要求Verilog语言能够描述信号的各种状态（0,1,x,z）、信号和模块的连接（例化）以及模块的逻辑（赋值以及各种...
2022-07-07 846
FPGA的Block RAM级联架构给AI/ML带来超高数据流通量
随着数据中心、人工智能、自动驾驶、5G、计算存储和先进测试等应用的数据量和数据流量不断增大，不仅需要引入高性能、高密度FPGA来发挥其并行计算和可编程硬件加速功能，而且还对大量数...
2022-07-06 985
FPGA中实现信号延时的资源消耗
在FPGA设计中我们经常会遇到对一个信号进行延时的情况，一般只延时一个或几个CLK时，通常是直接打拍，如果要延时的CLK较多时，我们会选择移位寄存器IP核，而有时为了方便，我们常常会使用...
2022-06-30 2209
先进FPGA开发工具中的时序分析
1. 概述 对于现今的FPGA芯片供应商，在提供高性能和高集成度独立FPGA芯片和半导体知识产权（IP）产品的同时，还需要提供性能卓越且便捷易用的开发工具。本文将以一家领先的FPGA解决方案提供...
2022-06-28 1436
中科亿海微：芯有灵犀 智创未来，世界FPGA珠峰攀登者
中科院团队：托举行业新星 中科亿海微电子科技（苏州）有限公司（企业官网：http://www.ehiway.cn/）是中科院空天信息创新研究院“可编程芯片与系统”研究领域的科研与产业化团队，按照国家...
2022-06-27 4860
基于SRAM技术的Xilinx FPGA
现代PLD的核电源为内部多数电路供电，所消耗的功率也最高。每一次新工艺的出现，都会产生新的核电源要求。支持PLD辅助电路的核电电源用于配置逻辑电路、时钟管理以及其他辅助功能电路。...
2022-06-21 4327
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