PLD设计速成(3)-采用VHDL设计输入三人表决器(2)

2012年05月18日 16:37 来源:本站整理 作者:秩名 我要评论(0)

3.2 新建VHDL文档

  (图形和verilog-HDL设计的过程见后面的部分)

  FILE->NEW

PLD设计速成-VHDL设计输入

  或者点下图的新建图标:

PLD设计速成-VHDL设计输入

  连后选择Text Editor File文件,点OK如下图

PLD设计速成-VHDL设计输入

 

上一页1234下一页

本文导航