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电子硬件DIY视频

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电子硬件DIY视频

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数字设计FPGA应用:Verilog HDL语言基本结构

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数字设计FPGA应用:7系列FPGA IOB

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数字设计FPGA应用:FPGA串口(A、B)电路设计

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FPGA之FPGA时序原理

FPGA的工作频率由FPGA芯片以及设计决定,可以通过修改设计或者更换更快的芯片来达到某些苛刻的要求....
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D触发器:结构及时序介绍

D触发器是一个具有记忆功能的,具有两个稳定状态的信息存储器件,是构成多种时序电路的最基本逻辑单元,也....
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时序逻辑:FPGA/ASIC电路结构

FPGA采用了逻辑单元阵列LCA(Logic Cell Array)这样一个概念,内部包括可配置逻辑....
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FPGA之入门大串讲

从芯片器件的角度讲,FPGA 本身构成 了半定制电路中的典型集成电路,其中含有数字管理模块、内嵌式单....
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FPGA之异步练习2:设计思路

异步双方不需要共同的时钟,也就是接收方不知道发送方什么时候发送,所以在发送的信息中就要有提示接收方开....
的头像 电子硬件DIY视频 发表于 12-02 07:03 1473次阅读
FPGA之异步练习2:设计思路

FPGA之FIFO练习1:设计思路

FIFO队列具有处理简单,开销小的优点。但FIFO不区分报文类型,采用尽力而为的转发模式,使对时间敏....
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FPGA之FIFO练习1:设计思路

用代码实现数字时钟功能及进行modelsim仿真

ModelSim是业界最优秀的HDL语言仿真软件,它能提供友好的仿真环境,是业界唯一的单内核支持VH....
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FPGA之FIFO练习

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FPGA之三态门

三态电路可提供三种不同的输出值:逻辑“0”,逻辑“1”和高阻态。高阻态主要用来将逻辑门同系统的其他部....
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FPGA之FIFO练习3:设计思路

根据FIFO工作的时钟域,可以将FIFO分为同步FIFO和异步FIFO。同步FIFO是指读时钟和写时....
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FPGA之异步练习2:接口时序参数

异步时序电路是指电路中除以使用带时钟的触发器外,还可以使用不带时钟的触发器和延迟元件作为存储元件;电....
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FPGA之流水线练习5:设计思路

流水线的工作方式就象工业生产上的装配流水线。在CPU中由5—6个不同功能的电路单元组成一条指令处理流....
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FPGA之流水线练习(2):设计思路

流水线安装时工作地的排列要符合工艺路线,当工序具有两个以上工作地时,要考虑同一工序工作地的排列方法。....
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FPGA之FIFO的原理概述

FIFO队列不对报文进行分类,当报文进入接口的速度大于接口能发送的速度时,FIFO按报文到达接口的先....
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CPU与FPGA通过异步接口信号实现通信

FPGA 的基本结构包括可编程输入输出单元,可配置逻辑块,数字时钟管理模块,嵌入式块RAM,布线资源....
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FPGA之流水线练习5:实现4输入的乘法运算

流水线工作方式可节约工厂生产成本,可一定程度上节约生产工人数量,实现一定程度的自动化生产,前期投入不....
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FPGA之流水线练习4:实现4输入的乘法运算

流水线是人和机器的有效组合,最充分体现设备的灵活性,它将输送系统、随行夹具和在线专机、检测设备有机的....
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实现包文对比模块的设计练习

FIFO是队列机制中最简单的,每个接口上都存在FIFO队列,表面上看FIFO队列并没有提供什么QoS....
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调用timequest工具对工程时序进行分析

TimeQuest Timing Analyzer是一个功能强大的,ASIC-style的时序分析工....
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FIFO的电路设计与仿真验证

在计算机中,先入先出队列是一种传统的按序执行方法,先进入的指令先完成并引退,跟着才执行第二条指令(指....
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FPGA之流水线练习(3):设计思路

流水线的平面设计应当保证零件的运输路线最短,生产工人操作方便,辅助服务部门工作便利,最有效地利用生产....
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如何实现一个四输入乘法器的设计

乘法器(multiplier)是一种完成两个互不相关的模拟信号相乘作用的电子器件。它可以将两个二进制....
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改变流水线练习1的电路结构

流水线在工业生产中扮演着重要的角色,优化流水线直接关系着产品的质量和生产的效率,因此成为企业不得不关....
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FPGA之为什么要进行流水线的设计

流水线又称为装配线,一种工业上的生产方式,指每一个生产单位只专注处理某一个片段的工作。以提高工作效率....
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FPGA时序:用quartus分析时序

Altera Quartus II 作为一种可编程逻辑的设计环境, 由于其强大的设计能力和直观易用的....
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